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參數(shù)資料
| 型號(hào)： | DS4830EVKIT# |
| 廠商： | Maxim Integrated Products |
| 文件頁(yè)數(shù)： | 28/30頁(yè) |
| 文件大小： | 0K |
| 描述： | EVAL KIT OPTICAL MICROCONTROLLER |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | * |
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DS4830
Optical Microcontroller
7
Maxim Integrated
3-WIRE DIGITAL InTERFACE SPECIFICATIOn
(VDD = 2.97V to 3.63V, TA = -40NC to +85NC, unless otherwise noted.) (See Figure 2.)
SPI DIGITAL InTERFACE SPECIFICATIOn
(VDD = 2.97V to 3.63V, TA = -40NC to +85NC, unless otherwise noted.) (See Figure 3 and Figure 4.)
PARAMETER
SYMBOL
COnDITIOnS
MIn
TYP
MAx
UnITS
MCL Clock Frequency
fSCLOUT
1000
kHz
MCL Duty Cycle
t3WDC
50
%
MDIO Setup Time
tDS
100
ns
MDIO Hold Time
tDH
100
ns
MCS Pulse-Width Low
tCSW
500
ns
MCS Leading Time Before the
First MCL Edge
tL
500
ns
MCS Trailing Time After the Last
MCL Edge
tT
500
ns
MDIO, MCL Load
CB3W
Total bus capacitance on one line
10
pF
PARAMETER
SYMBOL
COnDITIOnS
MIn
TYP
MAx
UnITS
SPI Master Operating Frequency 1/tMSPICK
fSYS/2
MHz
SPI Slave Operating Frequency
1/tSSPICK
fSYS/4
MHz
SPI I/O Rise/Fall Time
tSPI_RF
CL = 15pF, pullup = 560I
25
ns
MSPICK Output Pulse-Width
High/Low
tMCH, tMCL
tMSPICK/2
- tSPI_RF
ns
MSPIDO Output Hold After
MSPICK Sample Edge
tMOH
tMSPICK/2
- tSPI_RF
ns
MSPIDO Output Valid to
MSPICK Sample Edge (MSPIDO
Setup)
tMOV
tMSPICK/2
- tSPI_RF
ns
MSPIDI Input Valid to MSPICK
Sample Edge (MSPIDI Setup)
tMIS
2tSPI_RF
ns
MSPIDI Input to MSPICK Sample
Edge Rise/Fall Hold
tMIH
0
ns
MSPICK Inactive to MSPIDO
Inactive
tMLH
tMSPICK/2
- tSPI_RF
ns
SSPICK Input Pulse-Width High/
Low
tSCH, tSCL
tSSPICK/2
ns
SSPICS Active to First Shift
Edge
tSSE
tSPI_RF
ns
SSPIDI Input to SSPICK Sample
Edge Rise/Fall Setup
tSIS
tSPI_RF
ns
SSPIDI Input from SSPICK
Sample Edge Transition Hold
tSIH
tSPI_RF
ns
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PDF描述 |
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