參數(shù)資料
型號(hào)： DS3252
英文描述： Single/Dual/Triple/Quad DS3/E3/STS-1 LIUs
中文描述： 單/雙/三/四路、DS3/E3/STS-1 LIU
文件頁數(shù)： 54/71頁
文件大?。?/td> 925K
代理商： DS3252
DS3251/DS3252/DS3253/DS3254
54 of 71
Table 17-I. SPI Interface Timing
(V
DD
= 3.3V 5%, T
A
= -40°C to +85°C.) (
Figure 17-5
)
PARAMETER (Note 1)
SCLK Frequency
SCLK Cycle Time
CS
Setup to First SCLK Edge
CS
Hold time After Last SCLK Edge
SCLK High Time
SCLK Low Time
SDI Data Setup Time
SDI Data Hold Time
SDO Enable Time (High-Impedance to Output Active)
SDO Disable Time (Output Active to High-Impedance)
SDO Data Valid Time
SDO Data Hold Time After Update SCLK Edge
Note 1:
All timing is specified with 100pF load on all SPI pins.
Figure 17-5. SPI Interface Timing Diagram
SYMBOL
f
BUS
t
CYC
t
SUC
t
HDC
t
CLKH
t
CLKL
t
SUI
t
HDI
t
EN
t
DIS
t
DV
t
HDO
MIN
100
15
15
50
50
5
15
0
5
TYP
MAX
10
25
40
UNITS
MHz
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
CS
SCLK,
CPOL=0
SCLK,
CPOL=1
t
SUI
t
HDI
SDI
t
CYC
t
SUC
t
CLKH
t
CLKL
t
CLKL
t
CLKH
t
HDC
SDO
t
EN
t
DV
t
HDO
t
DIS
CPHA = 0
CPHA = 1
CS
SCLK,
CPOL=0
SCLK,
CPOL=1
t
CYC
t
SUC
t
CLKH
t
CLKL
t
CLKL
t
HDC
t
SUI
t
HDI
SDI
SDO
t
EN
t
DV
t
HDO
t
DIS
t
CLKH
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PDF描述
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