參數(shù)資料
型號： DS21Q43AT
廠商： Maxim Integrated Products
文件頁數(shù)： 21/60頁
文件大?。?/td> 0K
描述： IC FRAMER E1 QUAD 5V IND 128TQFP
產(chǎn)品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 72
控制器類型： E1 調幀器
接口： 并行/串行
電源電壓： 4.5 V ~ 5.5 V
電流 - 電源： 32mA
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 128-LQFP
供應商設備封裝： 128-LQFP（14x20）
包裝： 管件
產(chǎn)品目錄頁面： 1429 (CN2011-ZH PDF)
DS21Q43A
28 of 60
IMR2: INTERRUPT MASK REGISTER 2 (Address=17 Hex)
(MSB)
(LSB)
RMF
RAF
TMF
SEC
TAF
LOTC
RCMF
TSLIP
SYMBOL
POSITION
NAME AND DESCRIPTION
RMF
IMR2.7
Receive CAS Multiframe.
0=interrupt masked
1=interrupt enabled
RAF
IMR2.6
Receive Align Frame.
0=interrupt masked
1=interrupt enabled
TMF
IMR2.5
Transmit Multiframe.
0=interrupt masked
1=interrupt enabled
SEC
IMR2.4
1-Second Timer.
0=interrupt masked
1=interrupt enabled
TAF
IMR2.3
Transmit Align Frame.
0=interrupt masked
1=interrupt enabled
LOTC
IMR2.2
Loss Of Transmit Clock.
0=interrupt masked
1=interrupt enabled
RCMF
IMR2.1
Receive CRC4 Multiframe.
0=interrupt masked
1=interrupt enabled
TSLIP
IMR2.0
Transmit Side Elastic Store Slip.
0=interrupt masked
1=interrupt enabled
5.0 ERROR COUNT REGISTERS
There are a set of four counters in the DS21Q43A that record bipolar or code violations, errors in the
CRC4 SMF code words, E-bits as reported by the far end, and word errors in the FAS. Each of these four
counters are automatically updated on either 1-second boundaries (CCR2.7=0) or every 62.5 ms
(CCR2.7=1) as determined by the timer in Status Register 2 (SR2.4). Hence, these registers contain
performance data from either the previous second or the previous 100 ms. The user can use the interrupt
from the timer to determine when to read these registers. The user has a full second (or 62.5 ms) to read
the counters before the data is lost.
相關PDF資料
PDF描述
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參數(shù)描述
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