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參數(shù)資料
| 型號： | DS2165Q+T&R |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 15/17頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PROC ADPCM 16/24/32K 28-PLCC |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標(biāo)準(zhǔn)包裝： | 500 |
| 類型： | ADPCM 處理器 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 28-LCC（J 形引線） |
| 供應(yīng)商設(shè)備封裝： | 28-PLCC（11.51x11.51） |
| 包裝： | 帶卷 (TR) |
DS2165Q
7 of 17
TIME SLOT ASSIGNMENT/ORGANIZATION
On-board counters establish when PCM and ADPCM I/O occur. The counters are programmed by the
time slot registers. Time slot size (number of bits wide) is determined by the state of CP/ EX . The number
of time slots available is determined by the state of both CP/ EX and U/ A (Figures 7 through 10). For
example, if the X channel is set to compress (CP/ EX = 1) and it is set to expect
m-law data
(U/ A = 1), then the input port (XIN) is set up for 32 8-bit time slots and the output port (XOUT) is set up
for 64 4-bit time slots. The time slot organization is not dependent on which algorithm has been selected.
Note: Time slots are counted from the frame sync signal starting at the first rising edge of either CLKX
or CLKY after the frame sync.
Figure 7.
m-LAW PCM INTERFACE
Figure 8.
m-LAW ADPCM INTERFACE
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PDF描述 |
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參數(shù)描述 |
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| DS2167QN/T&R | 制造商:Maxim Integrated Products 功能描述:IC PROC ADPCM 16/24/32K 28-PLCC |
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