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參數(shù)資料
| 型號： | DS21552L+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 42/137頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC TXRX T1 1-CHIP 5V 100-LQFP |
| 產(chǎn)品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 90 |
| 功能： | 單芯片收發(fā)器 |
| 接口： | E1，HDLC，J1，T1 |
| 電路數(shù)： | 1 |
| 電源電壓： | 4.75 V ~ 5.25 V |
| 電流 - 電源： | 75mA |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP |
| 供應商設備封裝： | 100-LQFP（14x14） |
| 包裝： | 托盤 |
| 包括： | DSX-1 和 CSU 線路補償發(fā)生器，HDLC 控制器，帶內(nèi)回路代碼發(fā)生器和檢測器 |
| 產(chǎn)品目錄頁面： | 1430 (CN2011-ZH PDF) |
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DS21352/DS21552
136 of 137
Figure 24-12 TRANSMIT SIDE TIMING, ELASTIC STORE ENABLED
Figure 24-13 TRANSMIT LINE INTERFACE TIMING
t
F
t
R
TSYSCLK
TSER
TCHCLK
t
SL
t
SH
SP
TSSYNC
TCHBLK
t D3
tD3
t
tSU
HD
SU
tHD
Notes:
1. TSER is only sampled on the falling edge of TSYSCLK when the transmit side elastic store is enabled.
2. TCHCLK and TCHBLK are synchronous with TSYSCLK when the transmit side elastic store is enabled.
TCLKO
TPOSO, TNEGO
t DD
t
F
t
R
TCLKI
TPOSI, TNEGI
t
LL
t
LH
LP
tHD
tSU
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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