參數(shù)資料
型號: DS21458+
廠商: Maxim Integrated Products
文件頁數(shù): 69/269頁
文件大?。?/td> 0K
描述: IC LIU QUAD T1/E1/J1 256-CSBGA
產(chǎn)品培訓(xùn)模塊: Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝: 90
類型: 收發(fā)器
驅(qū)動器/接收器數(shù): 4/4
規(guī)程: IEEE 1149.1
電源電壓: 3.14 V ~ 3.47 V
安裝類型: 表面貼裝
封裝/外殼: 256-LBGA,CSBGA
供應(yīng)商設(shè)備封裝: 256-CSBGA(17x17)
包裝: 管件
產(chǎn)品目錄頁面: 1430 (CN2011-ZH PDF)
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DS21455/DS21458 Quad T1/E1/J1 Transceivers
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There are two ranges of receive sensitivity for both T1 and E1, which is selectable by the user. The EGL
bit of LIC1 (LIC1.4) selects the full or limited sensitivity.
The resultant E1 or T1 clock derived from MCLK is multiplied by 16 via an internal PLL and fed to the
clock recovery system. The clock recovery system uses the clock from the PLL circuit to form a 16 times
over-sampler, which is used to recover the clock and data. This oversampling technique offers
outstanding performance to meet jitter tolerance specifications shown in Figure 25-9.
Normally, the clock that is output at the RCLK pin is the recovered clock from the E1 AMI/HDB3 or T1
AMI/B8ZS waveform presented at the RTIP and RRING inputs. If the jitter attenuator is placed in the
receive path (as is the case in most applications), the jitter attenuator restores the RCLK to an
approximate 50% duty cycle. If the jitter attenuator is either placed in the transmit path or is disabled, the
RCLK output can exhibit slightly shorter high cycles of the clock. This is due to the highly over-sampled
digital clock recovery circuitry. See the Receive AC Timing Characteristics section for more details.
When no signal is present at RTIP and RRING, a receive carrier loss (RCL) condition will occur and the
RCLK will be derived from the JACLK source.
25.2.1 Receive Level Indicator
The DS21455/DS21458 will report the signal strength at RTIP and RRING in 2.5dB increments via RL3-
RL0 located in the Information Register 2 (INFO2). This feature is helpful when trouble shooting line
performance problems.
25.2.2 Receive G.703 Section 10 Synchronization Signal
The DS21455/DS21458 can receive a 2.048MHz square-wave synchronization clock as specified in
Section 10 of ITU G.703. To use this mode, set the receive synchronization clock enable (LIC3.2) = 1.
25.2.3 Monitor Mode
Monitor applications in both E1 and T1 require various flat gain settings for the receive-side circuitry.
The DS21455/DS21458 can be programmed to support these applications via the monitor mode control
bits MM1 and MM0 in the LIC3 register. Figure 25-3 depicts a typical monitor-mode application.
Figure 25-3. Typical Monitor Application
PRIMARY T1/E1
TERMINATING
DEVICE
T1/E1 LINE
Rm
X
MONITOR
PORT JACK
DS21455/
DS21458
F
M
R
Rt
SECONDARY T1/E1
TERMINATING DEVICE
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PDF描述
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參數(shù)描述
DS21458+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad E1-T1-J1 Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流(最大值):595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS21458DK 功能描述:網(wǎng)絡(luò)開發(fā)工具 DS21458 Dev Kit RoHS:否 制造商:Rabbit Semiconductor 產(chǎn)品:Development Kits 類型:Ethernet to Wi-Fi Bridges 工具用于評估:RCM6600W 數(shù)據(jù)速率:20 Mbps, 40 Mbps 接口類型:802.11 b/g, Ethernet 工作電源電壓:3.3 V
DS21458LDK 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流(最大值):595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS21458N 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad E1-T1-J1 Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流(最大值):595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS21458N+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad E1-T1-J1 Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流(最大值):595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray