參數(shù)資料
型號(hào)： DS21352LB+
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 24/137頁(yè)
文件大小： 0K
描述： IC TXRX T1 1-CHIP 3.3V 100-LQFP
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 90
功能： 單芯片收發(fā)器
接口： HDLC，T1
電路數(shù)： 1
電源電壓： 3.14 V ~ 3.47 V
電流 - 電源： 75mA
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 100-LQFP
供應(yīng)商設(shè)備封裝： 100-LQFP（14x14）
包裝： 托盤
包括： DSX-1 和 CSU 線路補(bǔ)償發(fā)生器，HDLC 控制器，帶內(nèi)回路代碼發(fā)生器和檢測(cè)器
產(chǎn)品目錄頁(yè)面： 1429 (CN2011-ZH PDF)
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DS21352/DS21552
12 of 137
50
TDATA
I
Transmit Data
51
TSYSCLK
I
Transmit System Clock
52
TSSYNC
I
Transmit System Sync
53
TCHCLK
O
Transmit Channel Clock
54
CO
O
Carry Out
55
MUX
I
Bus Operation
56
D0/AD0
I/O
Data Bus Bit0/ Address/Data Bus Bit 0
57
D1/AD1
I/O
Data Bus Bit1/ Address/Data Bus Bit 1
58
D2/AD2
I/O
Data Bus Bit 2/Address/Data Bus 2
59
D3/AD3
I/O
Data Bus Bit 3/Address/Data Bus Bit 3
60
DVSS
–
Digital Signal Ground
61
DVDD
-
Digital Positive Supply
62
D4/AD4
I/O
Data Bus Bit4/Address/Data Bus Bit 4
63
D5/AD5
I/O
Data Bus Bit 5/Address/Data Bus Bit 5
64
D6/AD6
I/O
Data Bus Bit 6/Address/Data Bus Bit 6
65
D7/AD7
I/O
Data Bus Bit 7/Address/Data Bus Bit 7
66
A0
I
Address Bus Bit 0
67
A1
I
Address Bus Bit 1
68
A2
I
Address Bus Bit 2
69
A3
I
Address Bus Bit 3
70
A4
I
Address Bus Bit 4
71
A5
I
Address Bus Bit 5
72
A6
I
Address Bus Bit 6
73
ALE (AS)/A7
I
Address Latch Enable/Address Bus Bit 7
74
RD*(DS*)
I
Read Input(Data Strobe)
75
CS*
I
Chip Select
76
FMS
I
Framer Mode Select
77
WR*(R/W*)
I
Write Input(Read/Write)
78
RLINK
O
Receive Link Data
79
RLCLK
O
Receive Link Clock
80
DVSS
–
Digital Signal Ground
81
DVDD
–
Digital Positive Supply
82
RCLK
O
Receive Clock
83
DVDD
–
Digital Positive Supply
84
DVSS
–
Digital Signal Ground
85
RDATA
O
Receive Data
86
RPOSI
I
Receive Positive Data Input
87
RNEGI
I
Receive Negative Data Input
88
RCLKI
I
Receive Clock Input
Table 4-1 PIN DESCRIPTION SORTED BY PIN NUMBER (cont.)
PIN
SYMBOL
TYPE
DESCRIPTION
89
RCLKO
O
Receive Clock Output
90
RNEGO
O
Receive Negative Data Output
91
RPOSO
O
Receive Positive Data Output
92
RCHCLK
O
Receive Channel Clock
93
RSIGF
O
Receive Signaling Freeze Output
94
RSIG
O
Receive Signaling Output
95
RSER
O
Receive Serial Data
96
RMSYNC
O
Receive Multiframe Sync
97
RFSYNC
O
Receive Frame Sync
98
RSYNC
I/O
Receive Sync
99
RLOS/LOTC
O
Receive Loss Of Sync/ Loss Of Transmit Clock
100
RSYSCLK
I
Receive System Clock
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PDF描述
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