參數(shù)資料
型號(hào)： CY8C22213
廠商： Cypress Semiconductor Corp.
英文描述： PSoC Mixed Signal Array
中文描述： PSoC混合信號(hào)陣列
文件頁(yè)數(shù)： 282/304頁(yè)
文件大?。?/td> 2956K
代理商： CY8C22213
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29. System Resets
CY8C22xxx Preliminary Data Sheet
282
Document No. 38-12009 Rev. *D
December 22, 2003
29.1.2
CPU_SCR1 Register
The CPU_SCR1 register is used to convey status and con-
trol of events related to internal resets and watchdog reset.
Bits 7 to 1: Reserved.
Bit 0: IRAMDIS.
The Initialize RAM Disable bit is a control
bit that is readable and writeable. The default value for this
bit is 0, which indicates that the maximum amount of SRAM
should be initialized on watchdog reset to a value of 00h.
When the bit is set, the minimum amount of SRAM is initial-
ized after a watchdog reset. For more information on this bit,
see the
“SROM Function Descriptions” on page 46
in the
SROM chapter.
For additional information, reference the
CPU_SCR1 regis-
ter on page 143
.
29.2
Timing Diagrams
29.2.1
Power On Reset (POR)
A Power-on Reset (POR) is triggered whenever the supply
voltage is below the POR trip point. POR ends once the sup-
ply voltage rises above this voltage. Refer to the POR and
LVD chapter for more information on the operation of the
POR block.
POR consists of two pieces: an imprecise POR (IPOR) and
a Precision POR (PPOR). ‘POR’ refers to the OR of these
two functions. IPOR has coarser accuracy and its trip point
is typically lower than PPOR’s trip point. PPOR is derived
from a circuit that is calibrated (during boot), for very accu-
rate location of the POR trip point.
During POR (POR=1), the IMO is powered off for low power
during start-up. Once POR de-asserts, the IMO is started
(see
Figure 29-1
).
POR configures register reset status bits as shown in
Table 29-2
. PPOR does not affect the BandGap Trim Regis-
ter (BDG_TR), but IPOR does reset this register.
29.2.2
External Reset (XRES)
A XRES reset is caused by pulling the Xres pin high. The
Xres pin has an always-on pull down resistor, so it does not
require an external pull down for operation and can be tied
directly to ground or left open. Behavior after XRES is simi-
lar to POR.
During XRES (XRES=1), the IMO is powered off for low
power during start-up. Once XRES de-asserts, the IMO is
started (see
Figure 29-1
).
XRES configures register reset status bits as shown in
Table 29-2
.
29.2.3
Watchdog Timer Reset (WDR)
The user has the option to enable the WDR, by clearing the
PORS bit in the CPU_SCR0 register. Once the PORS bit is
cleared, the Watchdog Timer cannot be disabled. The only
exception to this is if a POR/XRES event takes place, which
will disable the WDR. See
“Watchdog Timer (WDT)” on
page 79
for details of the watchdog operation.
When the watchdog timer expires, a watchdog event occurs
resulting in the reset sequence. Some WDR unique items
are as follows.
Chip reset asserts for one cycle of the CLK32K clock (at
its reset state).
I
The IMO is not halted during or after WDR, i.e., the part
does not go through a low power phase.
I
CPU operation re-starts one CLK32K cycle after the
internal reset de-asserts (see
Figure 29-2
).
I
WDR configures register reset status bits as shown in
Table 29-2
.
相關(guān)PDF資料
PDF描述
CY8C22213-24LFI PSoC Mixed Signal Array
CY8C22213-24PI PSoC Mixed Signal Array
CY8C22213-24PVI PSoC Mixed Signal Array
CY8C22213-24SI PSoC Mixed Signal Array
CY8C22213-24SIT PSoC Mixed Signal Array
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
CY8C22213-24LFI 功能描述:IC MCU 2K FLASH 256B 32VQFN RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:PSOC®1 CY8C22xxx 標(biāo)準(zhǔn)包裝:250 系列:LPC11Uxx 核心處理器:ARM? Cortex?-M0 芯體尺寸:32-位 速度:50MHz 連通性:I²C，Microwire，SPI，SSI，SSP，UART/USART，USB 外圍設(shè)備:欠壓檢測(cè)/復(fù)位，POR，WDT 輸入/輸出數(shù):40 程序存儲(chǔ)器容量:96KB（96K x 8） 程序存儲(chǔ)器類型:閃存 EEPROM 大小:4K x 8 RAM 容量:10K x 8 電壓 - 電源 (Vcc/Vdd):1.8 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 8x10b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:48-LQFP 包裝:托盤 其它名稱:568-9587
CY8C22213-24PI 功能描述:IC MCU 2K FLASH 256B 20-DIP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:PSOC®1 CY8C22xxx 標(biāo)準(zhǔn)包裝:250 系列:LPC11Uxx 核心處理器:ARM? Cortex?-M0 芯體尺寸:32-位 速度:50MHz 連通性:I²C，Microwire，SPI，SSI，SSP，UART/USART，USB 外圍設(shè)備:欠壓檢測(cè)/復(fù)位，POR，WDT 輸入/輸出數(shù):40 程序存儲(chǔ)器容量:96KB（96K x 8） 程序存儲(chǔ)器類型:閃存 EEPROM 大小:4K x 8 RAM 容量:10K x 8 電壓 - 電源 (Vcc/Vdd):1.8 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 8x10b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:48-LQFP 包裝:托盤 其它名稱:568-9587
CY8C22213-24PVI 功能描述:IC MCU 2K FLASH 256B 20-SSOP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:PSOC®1 CY8C22xxx 標(biāo)準(zhǔn)包裝:60 系列:BlueStreak ; LH7 核心處理器:ARM7 芯體尺寸:32-位 速度:84MHz 連通性:EBI/EMI，SPI，SSI，SSP，UART/USART 外圍設(shè)備:欠壓檢測(cè)/復(fù)位，DMA，LCD，POR，PWM，WDT 輸入/輸出數(shù):76 程序存儲(chǔ)器容量:- 程序存儲(chǔ)器類型:ROMless EEPROM 大小:- RAM 容量:32K x 8 電壓 - 電源 (Vcc/Vdd):1.7 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 8x10b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:144-LQFP 包裝:托盤
CY8C22213-24PVIT 功能描述:IC MCU 2K FLASH 256B 20-SSOP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:PSOC®1 CY8C22xxx 標(biāo)準(zhǔn)包裝:60 系列:BlueStreak ; LH7 核心處理器:ARM7 芯體尺寸:32-位 速度:84MHz 連通性:EBI/EMI，SPI，SSI，SSP，UART/USART 外圍設(shè)備:欠壓檢測(cè)/復(fù)位，DMA，LCD，POR，PWM，WDT 輸入/輸出數(shù):76 程序存儲(chǔ)器容量:- 程序存儲(chǔ)器類型:ROMless EEPROM 大小:- RAM 容量:32K x 8 電壓 - 電源 (Vcc/Vdd):1.7 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 8x10b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:144-LQFP 包裝:托盤
CY8C22213-24SI 功能描述:IC MCU 2K FLASH 256B 20-SOIC RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:PSOC®1 CY8C22xxx 標(biāo)準(zhǔn)包裝:60 系列:PSOC® 3 CY8C38xx 核心處理器:8051 芯體尺寸:8-位 速度:67MHz 連通性:EBI/EMI，I²C，LIN，SPI，UART/USART 外圍設(shè)備:電容感應(yīng)，DMA，LCD，POR，PWM，WDT 輸入/輸出數(shù):25 程序存儲(chǔ)器容量:64KB（64K x 8） 程序存儲(chǔ)器類型:閃存 EEPROM 大小:2K x 8 RAM 容量:8K x 8 電壓 - 電源 (Vcc/Vdd):1.71 V ~ 5.5 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 2x20b，D/A 4x8b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:48-VFQFN 裸露焊盤 包裝:托盤
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