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參數(shù)資料
| 型號(hào)： | CY3950V484-125BBI |
| 廠商： | Cypress Semiconductor Corp. |
| 英文描述： | CPLDs at FPGA Densities |
| 中文描述： | CPLD器件在FPGA的密度 |
| 文件頁(yè)數(shù)： | 50/86頁(yè) |
| 文件大?。?/td> | 1212K |
| 代理商： | CY3950V484-125BBI |
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Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. *H
Page 54 of 86
E3
IO0IO0
E4
GCTL0
E23
GCLK1
E24
IO5
E25
TDI
E26
TDO
F1
NC
IO0
F2
NC
IO0
F3
NC
IO0
F4
IO0IO0
F23
NC
IO5
F24
IO5
F25
IO5
F26
IO5
G1
IO0
G2
IO0
G3
IO/VREF0
G4
GCLK0
G23
GCTL1
G24
IO/VREF5
G25
IO5
G26
IO5
H1
IO0IO0
H2
NC
IO0
H3
NC
IO0
H4
VCCIO0
H23
VCCJTAG
H24
IO5
H25
IO5
H26
IO5
J1
NC
IO0
J2
NC
IO/VREF0
J3
NC
IO0
J4
VCCIO0
J23
VCCIO5
J24
NC
IO/VREF5
J25
IO5
J26
IO5
K1
NC
IO0
K2
NC
IO0
K3
NC
IO0
K4
VCC
K23
VCCIO5
K24
IO5
Table 12. 388 BGA Pin Table (continued)
Pin
CY39050
CY39100
CY39165
CY39200
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CY2308ZXC-1H | 3.3V Zero Delay Buffer |
| CY2308ZXC-5H | 3.3V Zero Delay Buffer |
| CY7C1069AV33-10BAI | 2M x 8 Static RAM |
| CY7C1069AV33-10ZC | 2M x 8 Static RAM |
| CY7C1069AV33-10ZI | 2M x 8 Static RAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CY3950V484-125BGC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY3950V484-125BGI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY3950V484-125MBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY3950V484-125MBI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY3950Z208-125BBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
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