- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄380142 > CY39030Z388-125BGI (Cypress Semiconductor Corp.) CPLDs at FPGA Densities PDF資料下載
參數(shù)資料
| 型號(hào)： | CY39030Z388-125BGI |
| 廠商： | Cypress Semiconductor Corp. |
| 英文描述： | CPLDs at FPGA Densities |
| 中文描述： | CPLD器件在FPGA的密度 |
| 文件頁(yè)數(shù)： | 23/86頁(yè) |
| 文件大小： | 1235K |
| 代理商： | CY39030Z388-125BGI |
第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)當(dāng)前第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)
Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. *H
Page 23 of 86
Cluster Memory Timing Parameter Values
Over the Operating Range
Channel Memory Timing Parameter Values
Over the Operating Range
SSTL2 I
SSTL2 II
HSTL I
HSTL II
HSTL III
HSTL IV
–0.02
–0.22
0.94
0.79
0.77
0.44
0.4
0.2
0.9
0.8
0.5
0.6
0
0
2.0
2.0
2.0
2.0
2.0
2.0
2.0
2.0
2.0
2.0
2.0
2.0
2.0
2.0
2.0
2.0
2.0
2.0
0.9
0.9
0.5
0.5
0.5
0.5
0.5
0.5
0.5
0.5
0.5
0.5
0.6
0.6
0.3
0.3
0.3
0.3
0.5
0.5
0.1
0
I/O Standard
Output Delay Adjustments
Input Delay Adjustments
t
IOIN
t
CKIN
Fast Slew Rate
t
EA
Slow Slew Rate
(additional delay to fast slew rate)
t
IODSLOW
t
EASLOW
t
IOD
t
ER
t
ERSLOW
t
IOREGPIN
Parameter
Asynchronous Mode Parameters
t
CLMAA
t
CLMPWE
t
CLMSA
t
CLMHA
t
CLMSD
t
CLMHD
Synchronous Mode Parameters
t
CLMCYC1
t
CLMCYC2
t
CLMS
t
CLMH
t
CLMDV1
t
CLMDV2
t
CLMMACS1
t
CLMMACS2
t
MACCLMS1
t
MACCLMS2
Internal Parameters
t
CLMCLAA
233
200
181
125
83
Unit
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
10.2
11
12
17
20
ns
ns
ns
ns
ns
ns
5.5
1.8
0.9
5.5
0.4
6
6.5
2.2
1.1
6.5
0.6
10
3.2
1.8
10
0.9
12
4.0
2.0
12
1.0
2.0
1.0
6.0
0.5
9.5
5.0
2.8
0
10
5.0
3.0
0
10.5
5.5
3.8
0
15
8.0
4.0
0
20
10.0
5.0
0
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
10
7.0
11
7.5
12
8.0
17
10
20
15
7.7
4.5
3.6
6.0
8.0
5.0
4.0
6.5
8.5
5.5
4.4
7.0
12
8.0
6.6
10
15
10
8.0
12
6
6
6.5
10
12
ns
Parameter
Dual-Port Asynchronous Mode Parameters
t
CHMAA
t
CHMPWE
5.5
t
CHMSA
1.8
t
CHMHA
0.9
t
CHMSD
5.5
t
CHMHD
0.4
t
CHMBA
233
200
181
125
83
Unit
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
10
11
12
17
20
ns
ns
ns
ns
ns
ns
ns
6.0
2.0
1.0
6.0
0.5
6.5
2.2
1.1
6.5
0.6
10
3.2
1.8
10
0.9
12
4.0
2.0
12
1.0
8.5
9.0
10.0
14.0
16.0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CY39030Z388-125MBC | CPLDs at FPGA Densities |
| CY39030Z388-125MBI | CPLDs at FPGA Densities |
| CY39030Z388-125MGC | CPLDs at FPGA Densities |
| CY39030Z388-125MGI | CPLDs at FPGA Densities |
| CY39030Z388-125NC | CPLDs at FPGA Densities |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CY39030Z484-125BBC | 制造商:CYPRESS 制造商全稱(chēng):Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39030Z484-125BBI | 制造商:CYPRESS 制造商全稱(chēng):Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39030Z676-125BBC | 制造商:CYPRESS 制造商全稱(chēng):Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39030Z676-125BBI | 制造商:CYPRESS 制造商全稱(chēng):Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39030Z676-125BGC | 制造商:CYPRESS 制造商全稱(chēng):Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
發(fā)布緊急采購(gòu)，3分鐘左右您將得到回復(fù)。