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Ultra37000 CPLD Family
Document #: 38-03007 Rev. *D
Page 28 of 64
Typical 3.3V Power Consumption
CY37032V
CY37064V
0
5
10
15
20
25
30
0
20
40
60
80
100
120
140
160
Frequency (MHz)
I
Low Power
High Speed
The typical pattern is a 16-bit up counter, per logic block, with outputs disabled.
V
CC
= 3.3V, T
A
= Room Temperature
0
5
10
15
20
25
30
35
40
45
0
20
40
60
Frequency (MHz)
80
100
120
140
I
Low Power
High Speed
The typical pattern is a 16-bit up counter, per logic block, with outputs disabled.
V
CC
= 3.3V, T
A
= Room Temperature
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