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Ultra37000 CPLD Family
Document #: 38-03007 Rev. *D
Page 24 of 64
Power Consumption
Switching Waveforms
(continued)
Output Enable/Disable
INPUT
t
ER
OUTPUTS
t
EA
Typical 5.0V Power Consumption
CY37032
0
10
20
30
40
50
60
0
50
100
150
200
250
Frequency (MHz)
I
High Speed
Low Power
The typical pattern is a 16-bit up counter, per logic block, with outputs disabled.
V
CC
= 5.0V, T
A
= Room Temperature
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| CY37128VP352-100NXC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:5V, 3.3V, ISRTM High-Performance CPLDs |
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