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參數(shù)資料
| 型號： | CY2308ZC-1HT |
| 英文描述： | Eight Distributed-Output Clock Driver |
| 中文描述： | 八分布式輸出時鐘驅(qū)動器 |
| 文件頁數(shù)： | 1/9頁 |
| 文件大小： | 110K |
| 代理商： | CY2308ZC-1HT |
10-output, 400-MHz LVPECL Zero Delay Buffer
CY23020-3
Cypress Semiconductor Corporation
Document #: 38-07473 Rev. *A
3901 North First Street
San Jose
,
CA 95134
408-943-2600
Revised June 5, 2003
Features
400-ps max Total Timing Budget
(TTB
) window
10 LVPECL outputs
1 LVPECL differential input
Selectable output frequency range from 100 to 400 MHz
Multiply by 2 option
15-ps RMS Cycle-Cycle Jitter
Power-down mode
Lock indicator
3.3V power supply
Available in 48-pin QFN package
Overview
TheCY23020-3 is a high-performance 400-MHz LVPECL
Output phase-locked loop (PLL)-based zero delay buffer
(ZDB) designed for high- speed clock distribution applications.
The device features a guaranteed TTB window specifying all
occurrences of output clocks with respect to the input
reference clock across variations in voltage, temperature,
process, frequency, and ramp rate.
Additionally, the CY23020-3 can be used as a fan-out buffer
via the S[1:2] control pins. In this mode, the PLL is bypassed
and the reference clock is routed to the output buffers.
Block Diagram
Pin Configurations
CY23020-3
48
F
B
O
U
T
+
47
46
45
F
B
I
N
-
44
N
C
43
L
O
C
K
42
V
D
D
C
41
G
N
D
C
40
R
E
F
-
39
R
E
F
+
38
V
D
D
37
Q
9
+
13
14
15
16
17
18
19
20
21
22
23
24
1
2
3
4
5
6
7
8
9
10
11
12
36
35
34
33
32
31
30
29
28
27
26
25
V
D
D
F
B
I
N
+
Q
4
-
G
N
D
S
2
S
1
M
U
L
R
A
N
G
E
G
N
D
C
V
D
D
C
V
D
D
C
G
N
D
C
G
N
D
Q
5
-
FBOUT-
GND
Q1-
Q1+
VDD
Q2+
Q2-
GND
Q3-
Q3+
VDD
Q4+
Q9-
GND
Q8-
Q8+
VDD
Q7+
Q7-
GND
Q6-
Q6+
VDD
Q5+
Q1+
Q1-
Q3+
Q3-
Q2+
Q2-
Q4+
Q4-
Q5+
Q4-
Q6+
Q6-
Q7+
Q8+
Q9+
FBOUT+
FBOUT-
PLL
Control
Logic
FBIN-
FBIN+
S1:2
RANGE
MUL
REF-
REF+
÷
1/
÷
2
÷
1
÷
2
LOCK
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CY2308ZC-5 | Eight Distributed-Output Clock Driver |
| CY2308ZI-5 | Eight Distributed-Output Clock Driver |
| CY2303 | Clocks and Buffers |
| CY2303SC | THREE DISTRIBUTED-OUTPUT CLOCK DRIVER|SOP|8PIN|PLASTIC |
| CY2303SI | THREE DISTRIBUTED-OUTPUT CLOCK DRIVER|SOP|8PIN|PLASTIC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CY2308ZC-5 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Eight Distributed-Output Clock Driver |
| CY2308ZC-5H | 功能描述:IC CLK ZDB 8OUT 133MHZ 16TSSOP RoHS:否 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發(fā)生器，PLL，頻率合成器 系列:- 產(chǎn)品變化通告:Product Discontinuation 04/May/2011 標準包裝:96 系列:- 類型:時鐘倍頻器，零延遲緩沖器 PLL:帶旁路 輸入:LVTTL 輸出:LVTTL 電路數(shù):1 比率 - 輸入:輸出:1:8 差分 - 輸入:輸出:無/無 頻率 - 最大:133.3MHz 除法器/乘法器:是/無 電源電壓:3 V ~ 3.6 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:16-TSSOP（0.173"，4.40mm 寬） 供應(yīng)商設(shè)備封裝:16-TSSOP 包裝:管件 其它名稱:23S08-5HPGG |
| CY2308ZC-5HT | 制造商:Cypress Semiconductor 功能描述:Zero Delay PLL Clock Driver Single 10MHz to 133MHz 16-Pin TSSOP T/R |
| CY2308ZI1H | 制造商:CYPRESS 功能描述:New |
| CY2308ZI-1H | 功能描述:時鐘緩沖器 3.3VZDB COM RoHS:否 制造商:Texas Instruments 輸出端數(shù)量:5 最大輸入頻率:40 MHz 傳播延遲（最大值）: 電源電壓-最大:3.45 V 電源電壓-最小:2.375 V 最大功率耗散: 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:LLP-24 封裝:Reel |
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