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參數(shù)資料
| 型號： | CXP921064AGA |
| 英文描述： | Microcontroller |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 27/34頁 |
| 文件大?。?/td> | 402K |
| 代理商： | CXP921064AGA |
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–
27
–
CXP921064A
Due to the total capacitance of the bus.
(8) I
2
C bus (CH0, CH1)
(Topr =
–
20 to +75
°
C, V
DD
= 2.7 to 3.3V, Vss = 0V reference)
Item
SCK clock frequency
Bus free time between
stop and start conditions
Hold time under (resend)
start condition
Hold time in SCL clock
low state
Hold time in SCL clock
high state
Setup time under (resend)
start condition
Data hold time
Data setup time
SCL, SDA signal output
rise time
SCL, SDA signal output
fall time
Setup time under stop
condition
SCL0
SCL1
SDA0
SDA1
SDA0, SDA1
SCL0, SCL1
SCL0
SCL1
SCL0
SCL1
SDA0, SDA1
SCL0, SCL1
SDA0, SDA1
SCL0, SCL1
SDA0, SDA1
SCL0, SCL1
SDA0, SDA1
SCL0, SCL1
SDA0, SDA1
SCL0, SCL1
SDA0, SDA1
SCL0, SCL1
t
SCL
t
BUF
t
HD;STA
t
Low
t
High
t
SU;STA
t
HD;DAT
t
SU;DAT
t
Rd
t
Rc
t
Fd
t
Fc
t
SU;STO
Symbol
Pins
Min.
Standard mode
High-speed mode
400
0.9
300
300
0
1.3
0.6
1.3
0.6
0.6
0
100
20 +
α
20 +
α
0.6
kHz
μs
μs
μs
μs
μs
μs
ns
ns
ns
μs
Max.
Min.
100
1000
300
0
4.7
4.0
4.7
4.0
4.7
0
250
4.0
Max.
Unit
SDA0
SDA1
SCL0
SCL1
t
BUF
t
SU;DAT
t
HD;STA
t
SCL
t
Fd
t
Rd
t
Rc
t
Fc
t
Low
t
HD;STA
t
HD;DAT
t
High
t
SU;STA
t
SU;STO
Fig.11. I
2
C bus timing
相關PDF資料 |
PDF描述 |
|---|---|
| CXP921F064A | CMOS 16-bit Single Chip Microcomputer |
| CXQ71011P | CPU System Clock Generator |
| CXQ71051P | USART |
| CXQ71054 | Timer Circuit |
| CXQ71054P | Analog Timer Circuit |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| CXP921F064A | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:CMOS 16-bit Single Chip Microcomputer |
| CXP922000 | 制造商:SONY 制造商全稱:Sony Corporation 功能描述:CMOS 16-bit Single Chip Microcomputer |
| CXP922032 | 制造商:SONY 制造商全稱:Sony Corporation 功能描述:CMOS 16-bit Single Chip Microcomputer |
| CXP922P032 | 制造商:SONY 制造商全稱:Sony Corporation 功能描述:CMOS 16-bit Single Chip Microcomputer |
| CXP92324 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
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