(TA = 25° C; V+ = 5 V ±" />
參數(shù)資料
型號(hào)： CS5512-BSZR
廠商： Cirrus Logic Inc
文件頁(yè)數(shù)： 25/26頁(yè)
文件大?。?/td> 0K
描述： IC ADC 20BIT EXTERNAL OSC 8-SOIC
標(biāo)準(zhǔn)包裝： 2,000
位數(shù)： 20
采樣率（每秒）： 326
數(shù)據(jù)接口： 串行
轉(zhuǎn)換器數(shù)目： 1
功率耗散（最大）： 2.5mW
電壓電源： 雙 ±
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 8-SOIC（0.209"，5.30mm 寬）
供應(yīng)商設(shè)備封裝： 8-SOIC
包裝： 帶卷 (TR)
輸入數(shù)目和類(lèi)型： 1 個(gè)差分，雙極
CS5510/11/12/13
8
DS337F4
SWITCHING CHARACTERISTICS - CS5511/13
(TA = 25° C; V+ = 5 V ±5%; V- = 0 V; Input Levels: Logic 0 = 0 V, Logic 1 = V+; CL = 50 pF)
Notes: 23. The internal oscillator in the CS5511/13 provides the master clock for performing conversions. Data is
retrieved from the serial port using the SCLK input pin.
24. The minimum SCLK rate for the CS5511/13 assumes that SCLK is logic 0 when idle. When data is being
read from the ADC, SCLK must be burst at a minimum rate of 10 kHz and with a minimum of a 10
percent duty cycle. Rates slower than this can potentially put the ADC into sleep as the sleep mode is
entered after SCLK is logic 1 for tSLP time.
25. On the CS5511/13, the serial clock (SCLK) is used to transfer data from the CS5511/13. If SCLK is held
high (logic 1) for tSLP or longer, the CS5511/13 enters sleep mode. To exit from sleep mode, SCLK must
be held low (logic 0) for tWAKE or longer.
26. Specified using 10% and 90% points on waveform of interest. Output loaded with 50 pF.
Parameter
Symbol
Min
Typ
Max
Unit
Internal Oscillator Timing
Internal Oscillator Frequency
(Note 23)
fosc
32
64
100
kHz
Internal Oscillator Drift Over Temperature
-
-0.02
-
%/°C
Serial Port Timing
Serial Clock Frequency
(Note 24)
SCLK
-
2
MHz
SCLK High to Enter Sleep
(Notes 24 and 25)
tSLP
200
-
2000
s
SCLK Low to Exit Sleep
(Notes 24 and 25)
tWAKE
10
-
s
Rise Times
(Note 26)
CSB
SCLK
SDO
trise
-
50
1.0
10
-
s
ns
Fall Times
(Note 26)
CSB
SCLK
SDO
tfall
-
50
1.0
10
-
s
ns
Serial Clock
Pulse Width High
Pulse Width Low
t6
t7
200
-
ns
SDO Read Timing
CS
to Data Valid
t8
--
150
ns
SCLK Falling to New Data Bit
t9
--
150
ns
CS
Rising to SDO Hi-Z
t10
--
150
ns
CS
Falling to SCLK Rising
t11
200
-
ns
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PDF描述
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