參數(shù)資料
型號(hào)： CS5361-KZZ
廠商： Cirrus Logic Inc
文件頁(yè)數(shù)： 9/23頁(yè)
文件大?。?/td> 0K
描述： IC ADC AUD 114DB 204KHZ 24-TSSOP
標(biāo)準(zhǔn)包裝： 62
位數(shù)： 24
采樣率（每秒）： 204k
數(shù)據(jù)接口： 串行
轉(zhuǎn)換器數(shù)目： 2
功率耗散（最大）： 235mW
電壓電源： 模擬和數(shù)字
工作溫度： -10°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 24-TSSOP（0.173"，4.40mm 寬）
供應(yīng)商設(shè)備封裝： 24-TSSOP
包裝： 管件
輸入數(shù)目和類型： 2 個(gè)差分，單極
產(chǎn)品目錄頁(yè)面： 755 (CN2011-ZH PDF)
配用： 598-1547-ND - BOARD EVAL FOR CS5361 STEREO ADC
其它名稱： 598-1087-5
CS5361
DS467F2
17
4.2.2
Master Mode
In Master mode, LRCK and SCLK operate as outputs. The left/right and serial clocks are internally derived from the
master clock with the left/right clock equal to Fs and the serial clock equal to 64x Fs, as shown in Figure 23. Refer
to Table 3 for common master clock frequencies.
÷ 128
÷ 256
÷ 64
M0
M1
LRCK Output
(Equal to Fs)
Single
Speed
Quad
Speed
Double
Speed
00
01
10
÷ 2
÷ 4
÷ 1
SCLK Output
Single
Speed
Quad
Speed
Double
Speed
00
01
10
÷ 2
÷ 1
0
1
MCLK
MDIV
Figure 23. CS5361 Master Mode Clocking
SAMPLE RATE (kHz)
MDIV = 0
MCLK (MHz)
MDIV = 1
MCLK (MHz)
32
8.192
16.384
44.1
11.2896
22.5792
48
12.288
24.576
64
8.192
16.384
88.2
11.2896
22.5792
96
12.288
24.576
176.4
11.2896
22.5792
192
12.288
24.576
Table 3. CS5361 Common Master Clock Frequencies
相關(guān)PDF資料
PDF描述
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CS5363-DZZ 功能描述:模數(shù)轉(zhuǎn)換器 - ADC IC 105 dB, 192kHz Stereo A/D conv RoHS:否 制造商:Texas Instruments 通道數(shù)量:2 結(jié)構(gòu):Sigma-Delta 轉(zhuǎn)換速率:125 SPs to 8 KSPs 分辨率:24 bit 輸入類型:Differential 信噪比:107 dB 接口類型:SPI 工作電源電壓:1.7 V to 3.6 V, 2.7 V to 5.25 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:VQFN-32
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CS5364 制造商:CIRRUS 制造商全稱:Cirrus Logic 功能描述:114 dB, 192 kHz, 4-Channel A/D Converter
CS5364_08 制造商:CIRRUS 制造商全稱:Cirrus Logic 功能描述:114 dB, 192 kHz, 4-Channel A/D Converter
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