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參數(shù)資料
| 型號(hào)： | CS4954-CQZR |
| 廠商： | Cirrus Logic Inc |
| 文件頁(yè)數(shù)： | 30/60頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC VID ENCODER NTSC/PAL 48-TQFP |
| 標(biāo)準(zhǔn)包裝： | 2,000 |
| 類型： | 視頻編碼器 |
| 電壓 - 電源，模擬： | 3.15 V ~ 5.25 V |
| 電壓 - 電源，數(shù)字： | 3.15 V ~ 5.25 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-LQFP |
| 供應(yīng)商設(shè)備封裝： | 48-TQFP（7x7） |
| 包裝： | 帶卷 (TR) |
| 配用： | CDB4955A-ND - EVALUATION BOARD FOR CS4955A |
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CS4954 CS4955
36
DS278F6
8.2
Register Description
A set of internal registers are available for control-
ling the operation of the CS4954/5. The registers
extend from internal address 0×00 through 0×5A.
Table 9 shows a complete list of these registers and
their internal addresses. Note that this table and the
subsequent register description section describe the
full register map for the CS4954 only. A complete
CS4955 register set description is available only to
MacrovisionTM ACP-PPV Licensed Buyers.
8.2.1 Control Registers
PADR
RD
PDAT[7:0]
Trd
Trpw
Trah
Trda
Trdh
Tas
Figure 28. 8-bit Parallel Host Port Timing: Address Read Cycle
WR
PADR
PDAT[7:0]
Tas
Twds
Twdh
Twpw
Twr
Twac
Figure 29. 8-bit Parallel Host Port Timing: Address Write Cycle
Address
Register Name
Type
Default value
0
×00
control_0
r/w
01h
0
×01
control_1
r/w
02h
0
×02
control_2
r/w
00h
0
×03
control_3
r/w
00h
0
×04
control_4
r/w
3Fh
0
×05
control_5
r/w
00h
0
×06
control_6
r/w
00h
0
×07
RESERVED
0
×08
bkg_color
r/w
03h
Table 9. Control Registers
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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