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參數(shù)資料
| 型號： | CS495314-DVZR |
| 廠商： | CIRRUS LOGIC INC |
| 元件分類： | 顏色信號轉(zhuǎn)換 |
| 中文描述： | COLOR SIGNAL DECODER, PQFP128 |
| 封裝： | LEAD FREE, LQFP-128 |
| 文件頁數(shù)： | 17/35頁 |
| 文件大?。?/td> | 295K |
| 代理商： | CS495314-DVZR |
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CS4953xx Data Sheet
32-bit Audio Decoder DSP Family
DS705PP8
24
Figure 14. Digital Audio Output Timing, Slave Mode (Relationship LRCLK to SCLK)
5.18 Switching Characteristics — SDRAM Interface
(SD_CLKOUT = SD_CLKIN)
Parameter
Symbol
Min
Typical
Max
Unit
SD_CLKIN high time
tsdclkh
2.3
—
ns
SD_CLKIN low time
tsdclkl
2.3
—
ns
SD_CLKOUT rise/fall time
tsdclkrf
——
1
ns
SD_CLKOUT Frequency
——
150
—
MHz
SD_CLKOUT duty cycle
—45
—
55
%
SD_CLKOUT rising edge to signal valid
tsdcmdv
——
3.8
ns
Signal hold from SD_CLKOUT rising edge
tsdcmdh
—1.1
—
ns
SD_CLKOUT rising edge to SD_DQMn valid
tsddqv
—3.8
—
ns
SD_DQMn hold from SD_CLKOUT rising edge
tsddqh
1.38
—
ns
SD_DATA valid setup to SD_CLKIN rising edge
tsddsu
1.3
—
ns
SD_DATA valid hold to SD_CLKIN rising edge
tsddh
1.38
—
ns
SD_CLKOUT rising edge to ADDRn valid
tsdav
—3.8
—
ns
DAO_SCLK
DAO_LRCLK
DAO_Dx
tdaoslrts
tdaosclk
DAO_SCLK
DAO_LRCLK
tdaosstlr
tdaosdv
tdaosclk
DAO_Dx
Note: In these diagrams, Falling edge is the inactive edge of DAO_SCLK
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CS495304-CVZ | |
| CS495304-CVZR | |
| CS5346-DQZR | |
| CS5346-DQZ | |
| CSBLA455KJ58-B0 | |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CS4953-CL | 制造商:CIRRUS 制造商全稱:Cirrus Logic 功能描述:NTSC/PAL Digital Video Encoder |
| CS4953-CQ | 制造商:CIRRUS 制造商全稱:Cirrus Logic 功能描述:NTSC/PAL Digital Video Encoder |
| CS4953XX | 制造商:CIRRUS 制造商全稱:Cirrus Logic 功能描述:32-bit Audio Decoder DSP Family with Dual DSP Engine Technology |
| CS4953XX_08 | 制造商:CIRRUS 制造商全稱:Cirrus Logic 功能描述:32-bit Audio Decoder DSP Family |
| CS4953XX_09 | 制造商:CIRRUS 制造商全稱:Cirrus Logic 功能描述:Audio Decoder DSP Family with Dual 32-bit DSP Engine Technology |
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