參數(shù)資料
型號: CMI8787
廠商: C-Media Electronics Inc.
英文描述: High Performance PCI Audio Processor
中文描述: 高性能的PCI音頻處理器
文件頁數(shù): 4/28頁
文件大小: 735K
代理商: CMI8787
C-Media High Performance PCI Audi o Processor
Oxygen
TM HD CMI8787 Datasheet v0.5
11
C-MEDIA CONFIDENTIAL
XSTOP#
22
DIO
PCI Stop. When active, indicates that the target is requesting that
the master stop the current transaction.
XPAR
23
DIO
PCI Parity. It is even parity across XAD[31:0] and XCB#[3:0].
XINTA#
118
DIO
PCI Interrupt Request A.
MPU-401 MIDI UART Interface
XTXD
54
DIO, PU MP-401 MIDI transmitter (output). It is also used as XGPIO5~8
and I2S ADC 3 configuration (input, 0: GPIO5~8, 1: I2S ADC 3)
at the rising edge of XRST.
XRXD
55
DI, PU MPU401 MIDI receiver.
I2S Interface
XDAC_MCLK
82
DO
I2S DAC master clock output.
XDAC_LRCK
83
DIO
I2S DAC Left/Right sample clock.
XDAC_BCLK
84
DIO
I2S DAC bit clock.
XDAC_SDOUT0
85
DO
I2S DAC channel 0,channel 1 serial data output.
XDAC_SDOUT1
86
DO
I2S DAC channel 2,channel 3 serial data output.
XDAC_SDOUT2
87
DO
I2S DAC channel 4,channel 5 serial data output.
XDAC_SDOUT3
88
DO
I2S DAC channel 6,channel 7 serial data output.
XADC1_MCLK
90
DO
I2S ADC 1 and I2S ADC 4 master clock output.
XADC1_LRCK
91
DIO
I2S ADC 1 Left/Right sample clock.
XADC1_BCLK
92
DIO
I2S ADC 1 bit clock.
XADC1_SDIN
93
DI, PU I2S ADC 1 serial data input.
XAC97_SDI1/
XADC1_SDIN1
58
DI, PD I2S ADC 1 serial data input 1. This pin is shared with AC97 serial
data input 1, and determined by XSPI_DOUT/XA1 input
configuration at the rising edge of XRST.
XADC2_MCLK
94
DO
I2S ADC 2 master clock output.
XADC2_LRCK
95
DIO
I2S ADC 2 Left/Right sample clock.
XADC2_BCLK
96
DIO
I2S ADC 2 bit clock.
XADC2_SDIN
97
DI, PU I2S ADC 2 serial data input.
XGPIO5/
XADC3_MCLK
98
DIO, PD I2S ADC 3 master clock output. This pin is shared with XGPIO5,
which is determined by XTXD input configuration at the rising
edge of XRST.
XGPIO6/
XADC3_BCLK
99
DIO, PD I2S ADC 3 bit clock. This pin is shared with XGPIO6, which is
determined by XTXD input configuration at the rising edge of
XRST.
XGPIO7/
XADC3_LRCK
100
DIO, PD I2S ADC 2 Left/Right sample clock. This pin is shared with
XGPIO7, which is determined by XTXD input configuration at
the rising edge of XRST.
XGPIO8/
XADC3_SDIN
101
DIO, PD GPIO8, default input. This pin is shared with XADC3_SDIN,
which determined by XTXD input configuration at the rising edge
of XRST.
AC-Link Interface
相關(guān)PDF資料
PDF描述
CMI8788 High Performance PCI Audio Processor
CMLSH2-4LSB 0.2 A, 40 V, 4 ELEMENT, SILICON, SIGNAL DIODE
CMLZDA36V 36 V, SILICON, UNIDIRECTIONAL VOLTAGE REGULATOR DIODE
CMO3CMC-FREQ CRYSTAL OSCILLATOR, CLOCK, 1.5 MHz - 156.25 MHz, CMOS OUTPUT
CMO3EDC-FREQ CRYSTAL OSCILLATOR, CLOCK, 1.5 MHz - 156.25 MHz, CMOS OUTPUT
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參數(shù)描述
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