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參數(shù)資料
| 型號： | C8051T606TDB |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 9/188頁 |
| 文件大小： | 0K |
| 描述： | CARD DAUGHTER MSOP SOCKET |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 模塊/板類型： | MSOP 插口模塊 |
| 適用于相關(guān)產(chǎn)品： | C8051T606 |
| 產(chǎn)品目錄頁面： | 626 (CN2011-ZH PDF) |
| 相關(guān)產(chǎn)品： | 336-1663-6-ND - IC 8051 MCU 1.5K-EEPROM 10-QFN 336-1663-2-ND - IC 8051 MCU 1.5K-EEPROM 10-QFN 336-1664-5-ND - IC 8051 MCU 1.5K-EEPROM 10-MSOP 336-1663-1-ND - IC 8051 MCU 1.5K-EEPROM 10-QFN 336-1662-5-ND - IC 8051 MCU 1.5K-EEPROM 11-QFN |
| 其它名稱： | 336-1667 |
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C8051T600/1/2/3/4/5/6
106
Rev. 1.2
22. Port Input/Output
Digital and analog resources are available through eight I/O pins on the C8051T600/1/2/3/4/5, or six I/O
pins on the C8051T606. Port pins P0.0-P0.7 can be defined as general-purpose I/O (GPIO), assigned to
one of the internal digital resources, or assigned to an analog function as shown in Figure 22.1. Port pin
P0.7 is shared with the C2 Interface Data signal (C2D). The designer has complete control over which
functions are assigned, limited only by the number of physical I/O pins. This resource assignment flexibility
is achieved through the use of a Priority Crossbar Decoder. Note that the state of a Port I/O pin can always
be read in the P0 port latch, regardless of the crossbar settings.
The crossbar assigns the selected internal digital resources to the I/O pins based on the Priority Decoder
Definition 22.3, are used to select internal digital functions.
All Port I/Os are 5 V tolerant (refer to Figure 22.2 for the Port cell circuit). The Port I/O cells are configured
as either push-pull or open-drain in the Port Output Mode registers (P0MDOUT). Complete Electrical
Specifications for Port I/O are given in Section “8. Electrical Characteristics” on page 30.
Figure 22.1. Port I/O Functional Block Diagram
XBR0, XBR1,
XBR2 Registers
Digital
Crossbar
Priority
Decoder
SYSCLK
2
(Internal
Di
gital
Si
gnals)
Highest
Priority
Lowest
Priority
P0
I/O
Cells
P0.3
P0.4
8
P0MDOUT,
P0MDIN Registers
SMBus
UART
T0, T1
2
4
PCA
P0
Port Latch
(P0.0-P0.7)
8
CP0
Outputs
2
To Analog Peripherals
(ADC0, CP0, VREF, EXTCLK)
P0.5
P0.6
(‘T600/1/2/3/4/5 Only)
P0.7
P0.2
P0.1
P0.0
(‘T600/1/2/3/4/5 Only)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IDC5020ER102M | INDUCTOR POWER 1000UH 0.3A SMD |
| IDC5020ER101M | INDUCTOR POWER 100UH 1.3A SMD |
| IDC5020ER100M | INDUCTOR POWER 10UH 3.9A SMD |
| PN-F672-E3 | ADAPTER 672-FPBGA LATTICEECP3 |
| VI-B7T-EY-F3 | CONVERTER MOD DC/DC 6.5V 50W |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| C8051T606ZDB | 功能描述:子卡和OEM板 QFN10 (2x2mm) Socket Daughter Card RoHS:否 制造商:BeagleBoard by CircuitCo 產(chǎn)品:BeagleBone LCD4 Boards 用于:BeagleBone - BB-Bone - Open Source Development Kit |
| C8051T606-ZM | 功能描述:8位微控制器 -MCU 1.5K OTP EPROM MCU RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
| C8051T606-ZMR | 功能描述:8位微控制器 -MCU 1.5K OTP EPROM MCU RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
| C8051T610DB24 | 功能描述:仿真器/模擬器 C8051T610 Family Socket Daughtr Board RoHS:否 制造商:Blackhawk 產(chǎn)品:System Trace Emulators 工具用于評估:C6000, C5000, C2000, OMAP, DAVINCI, SITARA, TMS470, TMS570, ARM 7/9, ARM Cortex A8/R4/M3 用于:XDS560v2 |
| C8051T610DB28 | 功能描述:子卡和OEM板 C8051T610 Family Socket Daughtr Board RoHS:否 制造商:BeagleBoard by CircuitCo 產(chǎn)品:BeagleBone LCD4 Boards 用于:BeagleBone - BB-Bone - Open Source Development Kit |
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