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參數(shù)資料
| 型號： | C8051T603-GM |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 27/188頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC 8051 MCU 4K-EEPROM 11-QFN |
| 產品培訓模塊： | Serial Communication Overview |
| 標準包裝： | 122 |
| 系列： | C8051T60x |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 25MHz |
| 連通性： | SMBus（2 線/I²C），UART/USART |
| 外圍設備： | POR，PWM，WDT |
| 輸入/輸出數(shù)： | 8 |
| 程序存儲器容量： | 4KB（4K x 8） |
| 程序存儲器類型： | OTP |
| RAM 容量： | 256 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 3.6 V |
| 振蕩器型： | 內部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 10-VFDFN 裸露焊盤 |
| 包裝： | 管件 |
| 配用： | 336-1404-ND - KIT DEV FOR C8051T60X MCU'S |
| 其它名稱： | 336-1656-5 |
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C8051T600/1/2/3/4/5/6
122
Rev. 1.2
All transactions are initiated by a master, with one or more addressed slave devices as the target. The
master generates the START condition and then transmits the slave address and direction bit. If the trans-
action is a WRITE operation from the master to the slave, the master transmits the data a byte at a time
and waits for an ACK from the slave at the end of each byte. For READ operations, the slave transmits the
data and waits for an ACK from the master at the end of each byte. At the end of the data transfer, the
master generates a STOP condition to terminate the transaction and free the bus. Figure 23.3 illustrates a
typical SMBus transaction.
Figure 23.3. SMBus Transaction
23.3.1. Transmitter Vs. Receiver
On the SMBus communications interface, a device is the “transmitter” when it is sending an address or
data byte to another device on the bus. A device is a “receiver” when an address or data byte is being sent
to it from another device on the bus. The transmitter controls the SDA line during the address or data byte.
After each byte of address or data information is sent by the transmitter, the receiver sends an ACK or
NACK bit during the ACK phase of the transfer, during which time the receiver controls the SDA line.
23.3.2. Arbitration
A master may start a transfer only if the bus is free. The bus is free after a STOP condition or after the SCL
and SDA lines remain high for a specified time (see Section “23.3.5. SCL High (SMBus Free) Timeout” on
page 123). In the event that two or more devices attempt to begin a transfer at the same time, an arbitra-
tion scheme is employed to force one master to give up the bus. The master devices continue transmitting
until one attempts a HIGH while the other transmits a LOW. Since the bus is open-drain, the bus will be
pulled LOW. The master attempting the HIGH will detect a LOW SDA and lose the arbitration. The winning
master continues its transmission without interruption; the losing master becomes a slave and receives the
rest of the transfer if addressed. This arbitration scheme is non-destructive: one device always wins, and
no data is lost.
23.3.3. Clock Low Extension
SMBus provides a clock synchronization mechanism, similar to I2C, which allows devices with different
speed capabilities to coexist on the bus. A clock-low extension is used during a transfer in order to allow
slower slave devices to communicate with faster masters. The slave may temporarily hold the SCL line
LOW to extend the clock low period, effectively decreasing the serial clock frequency.
23.3.4. SCL Low Timeout
If the SCL line is held low by a slave device on the bus, no further communication is possible. Furthermore,
the master cannot force the SCL line high to correct the error condition. To solve this problem, the SMBus
protocol specifies that devices participating in a transfer must detect any clock cycle held low longer than
25 ms as a “timeout” condition. Devices that have detected the timeout condition must reset the communi-
cation no later than 10 ms after detecting the timeout condition.
SLA6
SDA
SLA5-0
R/W
D7
D6-0
SCL
Slave Address + R/W
Data Byte
START
ACK
NACK
STOP
相關PDF資料 |
PDF描述 |
|---|---|
| NLAS4051DR2G | IC MUX/DEMUX 8X1 16SOIC |
| C8051T604-GM | IC 8051 MCU 2K-EEPROM 11-QFN |
| VI-B01-IX | CONVERTER MOD DC/DC 12V 75W |
| VI-B00-IX | CONVERTER MOD DC/DC 5V 75W |
| MC74LVX4066DR2G | IC MUX/DEMUX QUAD 1X1 14SOIC |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| C8051T603-GMR | 功能描述:8位微控制器 -MCU 4K OTP 11Pin QFN RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
| C8051T603-GS | 功能描述:8位微控制器 -MCU 4K OTP 14Pin SOIC RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
| C8051T603-GSR | 功能描述:8位微控制器 -MCU 4K OTP 14Pin SOIC RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
| C8051T604 | 制造商:SILABS 制造商全稱:SILABS 功能描述:Mixed Signal OTP EPROM MCU Family |
| C8051T604-GM | 功能描述:8位微控制器 -MCU 2K OTP 10ADC 11Pin QFN RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
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