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參數資料
| 型號： | C8051F020 |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數： | 194/272頁 |
| 文件大小： | 0K |
| 描述： | IC 8051 MCU 64K FLASH 100TQFP |
| 標準包裝： | 90 |
| 系列： | C8051F02x |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 25MHz |
| 連通性： | EBI/EMI，SMBus（2 線/I²C），SPI，UART/USART |
| 外圍設備： | 欠壓檢測/復位，POR，PWM，溫度傳感器，WDT |
| 輸入/輸出數： | 64 |
| 程序存儲器容量： | 64KB（64K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 4.25K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 3.6 V |
| 數據轉換器： | A/D 8x8b，8x12b; D/A 2x12b |
| 振蕩器型： | 內部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-TQFP |
| 包裝： | 托盤 |
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C8051F020/1/2/3
28
Rev. 1.4
1.7.
12-Bit Analog to Digital Converter
The C8051F020/1 has an on-chip 12-bit SAR ADC (ADC0) with a 9-channel input multiplexer and programmable
gain amplifier. With a maximum throughput of 100 ksps, the ADC offers true 12-bit accuracy with an INL of ±1LSB.
C8051F022/3 devices include a 10-bit SAR ADC with similar specifications and configuration options. The ADC0
voltage reference is selected between the DAC0 output and an external VREF pin. On C8051F020/2 devices, ADC0
has its own dedicated VREF0 input pin; on C8051F021/3 devices, the ADC0 shares the VREFA input pin with the 8-
bit ADC1. The on-chip 15 ppm/°C voltage reference may generate the voltage reference for other system components
or the on-chip ADCs via the VREF output pin.
The ADC is under full control of the CIP-51 microcontroller via its associated Special Function Registers. One input
channel is tied to an internal temperature sensor, while the other eight channels are available externally. Each pair of
the eight external input channels can be configured as either two single-ended inputs or a single differential input.
The system controller can also put the ADC into shutdown mode to save power.
A programmable gain amplifier follows the analog multiplexer. The gain can be set in software from 0.5 to 16 in
powers of 2. The gain stage can be especially useful when different ADC input channels have widely varied input
voltage signals, or when it is necessary to "zoom in" on a signal with a large DC offset (in differential mode, a DAC
could be used to provide the DC offset).
Conversions can be started in four ways; a software command, an overflow of Timer 2, an overflow of Timer 3, or an
external signal input. This flexibility allows the start of conversion to be triggered by software events, external HW
signals, or a periodic timer overflow signal. Conversion completions are indicated by a status bit and an interrupt (if
enabled). The resulting 10 or 12-bit data word is latched into two SFRs upon completion of a conversion. The data
can be right or left justified in these registers under software control.
Window Compare registers for the ADC data can be configured to interrupt the controller when ADC data is within
or outside of a specified range. The ADC can monitor a key voltage continuously in background mode, but not inter-
rupt the controller unless the converted data is within the specified window.
12-Bit
SAR
ADC
12
+
-
TEMP
SENSOR
+
-
+
-
+
-
9-to-1
AMUX
(SE or
DIFF)
+
-
X
AIN0.0
AIN0.1
AIN0.2
AIN0.3
AIN0.4
AIN0.5
AIN0.6
AIN0.7
AV+
Programmable Gain
Amplifier
Analog Multiplexer
Window Compare
Logic
ADC Data
Registers
Window
Compare
Interrupt
Conversion
Complete
Interrupt
Configuration, Control, and Data
Registers
Start
Conversion
Timer 3 Overflow
Timer 2 Overflow
Write to AD0BUSY
CNVSTR
External VREF
Pin
DAC0 Output
VREF
AGND
Figure 1.11. 12-Bit ADC Block Diagram
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PDF描述 |
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