參數(shù)資料
型號(hào)： BU35LVDS
英文描述： マルチメディアLSI
中文描述： マルチメディア大規(guī)模集成電路
文件頁數(shù)： 2/5頁
文件大?。?/td> 154K
代理商： BU35LVDS
BU16LVDS / BU35LVDS Series
IC
!
電気的特性
Ta = 0
～
70
°
C, V
DD
= 3.0
～
3.6V, R
X
CLK = 20
～
70MH
Z
, Input Clock jitter
≤
50pS
P-P
Parameter
Symbol
Min.
Typ.
Max.
Unit
Conditions
Cycle to Cycle
PLL
XRST
to Lock
H
L
R
X
I
IZ
10
10
μ
A
R
X
CLK
20
70
MHz
T
DISKM
500
+
500
ps
0
≤
R
X
V
IN
≤
5.5V
R
X
CLK
=
65MHz , R
X
V
TH
R
X
V
TL
=
200mV
R
X
V
CM
=
1.2V , R
X
V
CM
=
0mV
R
X
V
TH
R
X
V
TL
=
200mV
R
X
V
CM
=
0mV
R
X
CK to CKO
LVDS
DUTY
R
X
V
CM
=
1.2V
T
COJITC
150
300
ps
P-P
T
CODUTY
48
50
52
%
T
COSU
4
ns
T
COH
3
ns
T
ENPLL
1
ms
R
X
V
TH
50
100
mV
R
X
V
TL
100
50
mV
R
X
V
CM
1.0
1.2
1.5
V
R
X
V
TH
R
X
V
TL
=
200mV
R
X
V
CM
50
+
50
mV
R
X
V
TH
R
X
V
TL
=
200mV
!
応用例
XGA
、
SVGA
の
TFT
パネルにおけるインターフェース構(gòu)成例
T
X
OUT0
T
X
OUT0
+
T
X
OUT1
T
X
OUT1
+
T
X
OUT2
T
X
OUT2
+
T
X
CLK
T
X
CLK
+
R
X
O0N
R
X
O0P
R
X
O [5 : 0]
R
X
O [11 : 6]
R
X
O [17 : 12]
R
X
O [20 : 18]
R
X
OCLK
OddR [5 : 0]
OddG [5 : 0]
OddB [5 : 0]
OddCLK
VDE
Hsync
R
X
E [5 : 0]
R
X
E [11 : 6]
R
X
E [17 : 12]
R
X
E [20 : 18]
R
X
ECLK
EvenR [5 : 0]
EvenG [5 : 0]
EvenB [5 : 0]
EvenCLK
VDE
Hsync
R
X
O1N
R
X
O1P
R
X
O2N
R
X
O2P
R
X
OCN
R
X
OCP
100
1
μ
F
0.01
μ
F
to
DD
PLL GND
LVDS GND
Digital GND
Cable
BU16LVDS / BU35LVDS
100
100
100
LVDS Core
Control
Logic
V
DD
0.01
μ
F
1
μ
F
to
LVDS V
DD
to
DD
0.1
μ
F
1
μ
F
t
o
L
C
D
D
r
i
v
e
r
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