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參數(shù)資料
| 型號： | AXDA1800DLT3C |
| 元件分類： | 微處理器 |
| 英文描述： | Microprocessor |
| 中文描述： | 微處理器 |
| 文件頁數(shù)： | 49/104頁 |
| 文件大小： | 1769K |
| 代理商： | AXDA1800DLT3C |
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Chapter 8
Electrical Data
37
25175E—November 2002
AMD Athlon XP Processor Model 8 Data Sheet
Preliminary Information
8.9
SYSCLK and SYSCLK# DC Characteristics
Table 14 shows the DC characteristics of the SYSCLK and
SYSCLK# differential clocks. The SYSCLK signal represents
CLKIN and RSTCLK tied together while the SYSCLK# signal
represents CLKIN# and RSTCLK# tied together. For
information about SYSCLK and SYSCLK#, see “SYSCLK and
SYSCLK#” on page 76 and Table 23, “Pin Name
Abbreviations,” on page 56.
Figure 11 shows the DC characteristics of the SYSCLK and
SYSCLK# signals.
Figure 11. SYSCLK and SYSCLK# Differential Clock Signals
Table 14. SYSCLK and SYSCLK# DC Characteristics
Symbol
Description
Min
Max
Units
V
Threshold-DC
Crossing before transition is detected (DC)
400
mV
V
Threshold-AC
Crossing before transition is detected (AC)
450
mV
I
LEAK_P
Leakage current through P-channel pullup to V
CC_CORE
–1
mA
I
LEAK_N
Leakage current through N-channel pulldown to VSS (Ground)
1
mA
V
CROSS
Differential signal crossover
V
CC_CORE
/ 2±100
mV
C
PIN
Capacitance *
4
25 *
pF
Note:
*
The following processor inputs have twice the listed capacitance because they connect to two input pads—SYSCLK and SYSCLK#.
SYSCLK connects to CLKIN/RSTCLK. SYSCLK# connects to CLKIN#/RSTCLK#.
V
CROSS
V
Threshold-DC
= 400mV
V
Threshold-AC
= 450mV
相關PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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