參數(shù)資料
型號： AX2000-2FGG1152
廠商： Microsemi SoC
文件頁數(shù)： 256/262頁
文件大?。?/td> 0K
描述： IC FPGA AXCELERATOR 2M 1152-FBGA
標(biāo)準(zhǔn)包裝： 24
系列： Axcelerator
邏輯元件/單元數(shù)： 21504
RAM 位總計： 294912
輸入/輸出數(shù)： 684
門數(shù)： 2000000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 1152-BGA
供應(yīng)商設(shè)備封裝： 1152-FPBGA（35x35）
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Axcelerator Family FPGAs
Re vi s i on 18
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CLK1 and CLK2
Both PLL outputs, CLK1 and CLK2, can be used to drive a global resource, an adjacent PLL RefCLK
input, or a net in the FPGA core. Not all drive combinations are possible (Table 2-81).
Restrictions on CLK1 and CLK2
When both are driving global resources, they must be driving the same type of global resource
(i.e. either HCLK or CLK).
Only one can drive a routed net at any given time.
Table 2-82 and Table 2-83 specify all the possible CLK1 and CLK2 connections for the north and south
PLLs. HCLK1 and HCLK2 are used to denote the different HCLK networks when two are being driven at
the same time by a single PLL (Note that HCLK1 is the primary clock resource associated with the PLL,
and HCLK2 is the clock resource associated with the adjacent PLL). Likewise, CLK1 and CLK2 are used
to denote the different CLK networks when two are being driven at the same time by a single PLL
Table 2-81 PLL General Connections Rules
CLK1
CLK2
HCLK
CLK
HCLK
Routed net output
HCLK
NONE
HCLK
CLK
NONE
CLK
Note:
The PLL outputs remain Low when REFCLK is constant (either Low or High).
Table 2-82 North PLL Connections
CLK1
CLK2
HCLK1
Routed net
HCLK1
Unused
HCLK2
HCLK1
HCLK2
Routed net
HCLK2
Both HCLK1 and routed net
HCLK2
Unused
HCLK1
Unused
Routed net
Unused
Both HCLK1 and routed net
Unused
Routed net
HCLK1
Routed net
Unused
Both HCLK1 and HCLK2
Routed net
Both HCLK1 and HCLK2
Unused
Both HCLK1 and routed net
Unusable
Both HCLK2 and routed net
HCLK1
Both HCLK2 and routed net
Unused
HCLK1, HCLK2, and routed net
Unusable
Note:
Designer software currently does not support all of these connections. Only exclusive connections
where one output connects to a single net are supported at this time (e.g.CLK1 driving HCLK1,
and HCLK2 is not supported).
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PDF描述
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AX2000-2FGG896 功能描述:IC FPGA AXCELERATOR 2M 896-FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Axcelerator 標(biāo)準(zhǔn)包裝:1 系列:ProASICPLUS LAB/CLB數(shù):- 邏輯元件/單元數(shù):- RAM 位總計:129024 輸入/輸出數(shù):248 門數(shù):600000 電源電壓:2.3 V ~ 2.7 V 安裝類型:表面貼裝 工作溫度:- 封裝/外殼:352-BFCQFP，帶拉桿 供應(yīng)商設(shè)備封裝:352-CQFP（75x75）
AX2000-2FGG896B 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Axcelerator Family FPGAs
AX2000-2FGG896I 功能描述:IC FPGA AXCELERATOR 2M 896-FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Axcelerator 標(biāo)準(zhǔn)包裝:1 系列:ProASICPLUS LAB/CLB數(shù):- 邏輯元件/單元數(shù):- RAM 位總計:129024 輸入/輸出數(shù):248 門數(shù):600000 電源電壓:2.3 V ~ 2.7 V 安裝類型:表面貼裝 工作溫度:- 封裝/外殼:352-BFCQFP，帶拉桿 供應(yīng)商設(shè)備封裝:352-CQFP（75x75）
AX2000-2FGG896M 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Axcelerator Family FPGAs
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