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參數(shù)資料
| 型號(hào)： | AX125-1FG324 |
| 廠商： | Microsemi SoC |
| 文件頁數(shù)： | 176/262頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA AXCELERATOR 125K 324FBGA |
| 標(biāo)準(zhǔn)包裝： | 84 |
| 系列： | Axcelerator |
| 邏輯元件/單元數(shù)： | 1344 |
| RAM 位總計(jì)： | 18432 |
| 輸入/輸出數(shù)： | 168 |
| 門數(shù)： | 125000 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 324-BGA |
| 供應(yīng)商設(shè)備封裝： | 324-FBGA（19x19） |
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Axcelerator Family FPGAs
Re vi s i on 18
4-3
Revision 12
(v2.4)
Revised ordering information and timing data to reflect phase out of –3 speed
grade options.
Table 2-3 was updated.
Revision 11
(v2.3)
The "Packaging Data" section is new.
Table 2-2 was updated.
"VCCDA Supply Voltage" was updated.
"PRA/B/C/D Probe A, B, C and D" was updated.
The "User I/Os" was updated.
Revision 10
(v2.2)
Figure 1-3 was updated.
Table 2-2 was updated.
The "Power-Up/Down Sequence" section was updated.
Table 2-4 was updated.
Table 2-5 was updated.
The "Timing Characteristics" section was added.
Table 2-7 was updated.
Figure 2-1 was updated.
The External Setup and Clock-to-Out (Pad-to-Pad) equations in the "Hardwired
Clock – Using LVTTL 24 mA High Slew Clock I/O" section were updated.
The External Setup and Clock-to-Out (Pad-to-Pad) in the "Routed Clock – Using
LVTTL 24 mA High Slew Clock I/O" section were updated.
The "Global Pins" section was updated.
The "User I/Os" section was updated.
Table 2-17 was updated.
Figure 2-8 was updated.
Figure 2-13 and Figure 2-14 were updated.
The following timing parameters were renamed in I/O timing characteristic
tables from Table 2-22 to Table 2-60:
tIOCLKQ > tICLKQ
tIOCLKY > tOCLKQ
Timing numbers were updated from Table 2-22 to Table 2-78.
The "R-Cell" section was updated.
Figure 2-59 was updated.
Figure 2-60 was updated.
Figure 2-67 was updated.
Figure 2-68 was updated.
Table 2-89 to Table 2-93 were updated.
Table 2-98 to Table 2-102 were updated.
2-102 to
Revision
Changes
Page
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| AYM31DTBT | CONN EDGECARD 62POS R/A .156 SLD |
| ASM31DTBT | CONN EDGECARD 62POS R/A .156 SLD |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AX125-1FG324I | 功能描述:IC FPGA AXCELERATOR 125K 324FBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:Axcelerator 標(biāo)準(zhǔn)包裝:40 系列:SX-A LAB/CLB數(shù):6036 邏輯元件/單元數(shù):- RAM 位總計(jì):- 輸入/輸出數(shù):360 門數(shù):108000 電源電壓:2.25 V ~ 5.25 V 安裝類型:表面貼裝 工作溫度:0°C ~ 70°C 封裝/外殼:484-BGA 供應(yīng)商設(shè)備封裝:484-FPBGA（27X27） |
| AX125-1FG896 | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Axcelerator Family FPGAs |
| AX125-1FG896B | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Axcelerator Family FPGAs |
| AX125-1FG896I | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Axcelerator Family FPGAs |
| AX125-1FG896M | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Axcelerator Family FPGAs |
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