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參數(shù)資料
| 型號(hào)： | AX1000-BG729IX79 |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 12096 CLBS, 612000 GATES, 649 MHz, PBGA729 |
| 封裝： | 1.27 MM PITCH, BGA-729 |
| 文件頁(yè)數(shù)： | 227/230頁(yè) |
| 文件大?。?/td> | 6485K |
| 代理商： | AX1000-BG729IX79 |
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Axcelerator Family FPGAs
2- 82
v2.8
Figure 2-63 illustrates flag generation. The Verilog codes for the flags are:
assign AF = (DIFF[15:0] >={AFVAL[7:0],8'b00000000})?1:0;
assign AE = ({AEVAL[7:0],8'b00000000}>=DIFF[15:0])?1:0;
The number of DIFF-bits active depends on the configuration depth and width (Table 2-94).
Figure 2-63 ALMOST-EMPTY and ALMOST-FULL Logic
Table 2-94 Number of Available Configuration Bits
Number of Blocks
Block DxW
Number of AEVAL/AFVAL Bits
11x1
4
21x2
4
22x1
5
41x4
4
42x2
5
44x1
6
81x8
4
82x4
5
84x2
6
88x1
7
16
1x16
4
16
2x8
5
16
4x4
6
16
8x2
7
16
16x1
8
ALMOST EMPTY and ALMOST FULL Logic
WCNTR
[15:0]
WCLK
RCNTR
[15:0]
RCLK
16
X
Y
X
Y
AEMPTY
AFULL
X>=Y
(16 bit)
DIFF [15:0]
AEVAL [7:0], GND [7:0] (MSB....LSB)
AFVAL [7:0], GND [7:0] (MSB....LSB)
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PDF描述 |
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參數(shù)描述 |
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