參數(shù)資料
型號(hào)： AX1000-1FGG484
廠(chǎng)商： Microsemi SoC
文件頁(yè)數(shù)： 185/262頁(yè)
文件大小： 0K
描述： IC FPGA AXCELERATOR 1M 484-FBGA
標(biāo)準(zhǔn)包裝： 40
系列： Axcelerator
邏輯元件/單元數(shù)： 12096
RAM 位總計(jì)： 165888
輸入/輸出數(shù)： 317
門(mén)數(shù)： 1000000
電源電壓： 1.425 V ~ 1.575 V
安裝類(lèi)型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 484-BGA
供應(yīng)商設(shè)備封裝： 484-FPBGA（23x23）
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Axcelerator Family FPGAs
Re vi s i on 18
2 - 15
Table 2-13 summarizes the different combinations of voltages and I/O standards that can be used
together in the same I/O bank.
Note that two I/O standards are compatible if:
Their VCCI values are identical.
Their VREF standards are identical (if applicable).
For example, if LVTTL 3.3 V (VREF= 1.0 V) is used, then the other available (i.e. compatible) I/O
standards in the same bank are LVTTL 3.3 V PCI/PCI-X, GTL+, and LVPECL.
Also note that when multiple I/O standards are used within a bank, the voltage tolerance will be limited to
the minimum tolerance of all I/O standards used in the bank.
Table 2-13 Legal I/O Usage Matrix
I/O Standard
L
V
T
L
3.3
V
L
V
CM
OS
2.
5
V
L
V
C
M
OS1.8
V
L
V
CM
OS1.5
V
(JESD8-1
1
)
3.3V
PCI/
PCI-X
G
T
L
+
(3
.3
V)
G
T
L
+
(2
.5
V)
HST
L
Class
I
(1
.
5V)
SST
L2
Class
I
&
II
(2.5
V)
SST
L3
Class
I
&
II
(3.3
V)
L
V
DS
(2.5
V)
L
V
PECL
(3.3
V)
LVTTL 3.3 V (VREF=1.0 V)
–––
––
–
LVTTL 3.3 V(VREF=1.5 V)
–––
––
–
LVCMOS 2.5 V (VREF=1.0 V)
–
––
–
––
–
LVCMOS 2.5 V (VREF=1.25V)
–
––
–
LVCMOS1.8 V
–
––
–
LVCMOS1.5 V (VREF = 1.75 V) (JESD8-11)
–
––
–
––
–
3.3 V PCI/PCI-X (VREF = 1.0 V)
–––
––
–
3.3 V PCI/PCI-X (VREF= 1.5 V)
–––
––
–
GTL + (3.3 V)
–––
––
–
GTL + (2.5 V)
–
––
–
––
–
HSTL Class I
–
––
–
––
–
SSTL2 Class I & II
–
––
–
SSTL3 Class I & II
–––
––
–
LVDS (VREF = 1.0 V)
–
––
–
––
–
LVDS (VREF = 1.25 V)
–
––
–
LVPECL (VREF = 1.0 V)
–––
––
–
LVPECL (VREF = 1.5 V)
–––
––
–
Notes:
1. Note that GTL+ 2.5 V is not supported across the full military temperature range.
2. A "
" indicates whether standards can be used within a bank at the same time.
Examples:
a) LVTTL can be used with 3.3V PCI and GTL+ (3.3V), when VREF = 1.0V (GTL+ requirement).
b) LVTTL can be used with 3.3V PCI and SSTL3 Class I and II, when VREF = 1.5V (SSTL3 requirement).
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