參數(shù)資料
型號(hào)： ATSAM3U2CA-CU
廠商： Atmel
文件頁(yè)數(shù)： 45/60頁(yè)
文件大?。?/td> 0K
描述： IC MCU 32BIT 128KB FLSH 100TFBGA
產(chǎn)品培訓(xùn)模塊： MCU Product Line Introduction
Cortex®-M3 Introduction and Specific SAM3U Implementation
SAM3U Cortex-M3 Based MCU Introduction
Touch Solutions on the Atmel ARM? Cortex?-M3 Based Flash Microcontrollers
標(biāo)準(zhǔn)包裝： 260
系列： SAM3U
核心處理器： ARM? Cortex?-M3
芯體尺寸： 32-位
速度： 96MHz
連通性： EBI/EMI，I²C，MMC，SPI，SSC，UART/USART，USB
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，DMA，I²S，POR，PWM，WDT
輸入/輸出數(shù)： 57
程序存儲(chǔ)器容量： 128KB（128K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 36K x 8
電壓 - 電源 (Vcc/Vdd)： 1.62 V ~ 1.95 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 4x10b，4x12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 100-TFBGA
包裝： 托盤(pán)
配用： ATSAM3U-EK-ND - KIT EVAL FOR AT91SAM3U CORTEX
5
6430FS–ATARM–10-Feb-12
SAM3U Series
3.
Signal Description
Table 3-1 gives details on the signal names classified by peripheral.
Table 3-1.
Signal Description List
Signal Name
Function
Type
Active
Level
Voltage
Reference
Comments
Power Supplies
VDDIO
Peripherals I/O Lines Power Supply
Power
1.62V to 3.6V
VDDIN
Voltage Regulator Input
Power
1.8V to 3.6V
VDDOUT
Voltage Regulator Output
Power
1.8V
VDDUTMII
USB UTMI+ Interface Power Supply
Power
3.0V to 3.6V
GNDUTMII
USB UTMI+ Interface Ground
Ground
VDDBU
Backup I/O Lines Power Supply
Power
1.62V to 3.6V
GNDBU
Backup Ground
Ground
VDDPLL
PLL A, UPLL and OSC 3-20 MHz Power Supply
Power
1.62 V to 1.95V
GNDPLL
PLL A, UPLL and OSC 3-20 MHz Ground
Ground
VDDANA
ADC Analog Power Supply
Power
2.0V to 3.6V
GNDANA
ADC Analog Ground
Ground
VDDCORE
Core, Memories and Peripherals Chip Power
Supply
Power
1.62V to 1.95V
GND
Ground
Clocks, Oscillators and PLLs
XIN
Main Oscillator Input
Input
VDDPLL
XOUT
Main Oscillator Output
Output
XIN32
Slow Clock Oscillator Input
Input
VDDBU
XOUT32
Slow Clock Oscillator Output
Output
VBG
Bias Voltage Reference
Analog
PCK0 - PCK2
Programmable Clock Output
Output
VDDIO
Shutdown, Wakeup Logic
SHDN
Shut-Down Control
Output
VDDBU
push/pull
0: The device is in
backup mode
1: The device is running
(not in backup mode)
FWUP
Force Wake-Up Input
Input
Low
Needs external pull-up
Serial Wire/JTAG Debug Port (SWJ-DP)
TCK/SWCLK
Test Clock/Serial Wire Clock
Input
VDDIO
No pull-up resistor
TDI
Test Data In
Input
No pull-up resistor
TDO/TRACESWO
Test Data Out/Trace Asynchronous Data Out
Output(4)
TMS/SWDIO
Test Mode Select/Serial Wire Input/Output
Input
No pull-up resistor
JTAGSEL
JTAG Selection
Input
High
VDDBU
Internal permanent
pull-down
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PDF描述
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