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參數(shù)資料
| 型號： | ATF1502ASV-15AU44 |
| 廠商： | Atmel |
| 文件頁數(shù)： | 6/25頁 |
| 文件大小： | 0K |
| 描述： | IC CPLD EE HP 15NS 44-TQFP |
| 標準包裝： | 160 |
| 系列： | ATF15xx |
| 可編程類型： | 系統(tǒng)內(nèi)可編程（最少 10,000 次編程/擦除循環(huán)） |
| 最大延遲時間 tpd(1)： | 15.0ns |
| 電壓電源 - 內(nèi)部： | 3 V ~ 3.6 V |
| 宏單元數(shù)： | 32 |
| 輸入/輸出數(shù)： | 32 |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 44-TQFP |
| 供應商設(shè)備封裝： | 44-TQFP（10x10） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 608 (CN2011-ZH PDF) |
| 配用： | ATF15XX-DK3-ND - KIT DEV FOR ATF15XX CPLD'S |
14
1615J–PLD–01/06
ATF1502ASV
13. AC Characteristics
Table 13-1.
AC Characteristics
Symbol
Parameter
-15
-20
Units
Min
Max
Min
Max
t
PD1
Input or Feedback to Non-registered Output
3
15
20
ns
tPD2
I/O Input or Feedback to Non-registered Feedback
3
12
16
ns
tSU
Global Clock Setup Time
11
16
ns
t
H
Global Clock Hold Time
0
ns
tFSU
Global Clock Setup Time of Fast Input
3
ns
tFH
Global Clock Hold Time of Fast Input
1
1.5
MHz
t
COP
Global Clock to Output Delay
8
10
ns
tCH
Global Clock High Time
5
6
ns
tCL
Global Clock Low Time
5
6
ns
t
ASU
Array Clock Setup Time
4
ns
tAH
Array Clock Hold Time
4
5
ns
tACOP
Array Clock Output Delay
15
20
ns
t
ACH
Array Clock High Time
6
8
ns
tACL
Array Clock Low Time
6
8
ns
tCNT
Minimum Clock Global Period
13
16
ns
f
CNT
Maximum Internal Global Clock Frequency
76.9
66
MHz
tACNT
Minimum Array Clock Period
13
16
ns
f
ACNT
Maximum Internal Array Clock Frequency
76.9
66
MHz
f
MAX
Maximum Clock Frequency
100
83.3
MHz
tIN
Input Pad and Buffer Delay
2
ns
t
IO
I/O Input Pad and Buffer Delay
2
ns
t
FIN
Fast Input Delay
2
ns
tSEXP
Foldback Term Delay
8
10
ns
t
PEXP
Cascade Logic Delay
1
ns
t
Logic Array Delay
6
7
ns
tLAC
Logic Control Delay
6
7
ns
t
IOE
Internal Output Enable Delay
3
ns
tOD1
Output Buffer and Pad Delay
(Slow slew rate = OFF;
V
CC = 3.3V; CL = 35 pF)
55
ns
tZX1
Output Buffer Enable Delay
(Slow slew rate = OFF;
V
CCIO = 5.0V; CL = 35 pF)
79
ns
tZX2
Output Buffer Enable Delay
(Slow slew rate = OFF;
V
CCIO = 3.3V; CL = 35 pF)
79
ns
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