參數(shù)資料
型號(hào)： AT91SAM9261-CJ
廠商： Atmel
文件頁(yè)數(shù)： 17/44頁(yè)
文件大小： 0K
描述： IC ARM9 MPU 217BGA
標(biāo)準(zhǔn)包裝： 126
系列： AT91SAM
核心處理器： ARM9
芯體尺寸： 16/32-位
速度： 190MHz
連通性： EBI/EMI，I²C，MMC，SPI，SSC，UART/USART，USB
外圍設(shè)備： DMA，LCD，POR，PWM，WDT
輸入/輸出數(shù)： 96
程序存儲(chǔ)器容量： 32KB（32K x 8）
程序存儲(chǔ)器類型： ROM
RAM 容量： 192K x 8
電壓 - 電源 (Vcc/Vdd)： 1.08 V ~ 1.32 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 217-LFBGA
包裝： 托盤
配用： AT91SAM9261-EK-ND - KIT EVAL FOR AT91SAM926EJ-S
AT91SAM-ICE-ND - EMULATOR FOR AT91 ARM7/ARM9
其它名稱： AT91SAM9261B-CJ
AT91SAM9261B-CJ-ND
24
6062LS–ATARM–23-Mar-09
AT91SAM9261
9.2
Reset Controller
Based on two Power-on-Reset cells
Status of the last reset
– Either cold reset, first reset, soft reset, user reset, watchdog reset, wake-up reset
Controls the internal resets and the NRST pin output
9.3
Shutdown Controller
Shutdown and Wake-up logic:
– Software programmable assertion of the SHDN pin
– Deassertion Programmable on a WKUP pin level change or on alarm
9.4
General-purpose Backup Registers
Four 32-bit general-purpose backup registers
9.5
Clock Generator
Embeds the Low-power 32768 Hz Slow Clock Oscillator
– Provides the permanent Slow Clock to the system
Embeds the Main Oscillator
– Oscillator bypass feature
– Supports 3 to 20 MHz crystals
Embeds Two PLLs
– Outputs 80 to 240 MHz clocks
– Integrates an input divider to increase output accuracy
– 1 MHz minimum input frequency
Provides SLCK, MAINCK, PLLACK and PLLBCK.
Figure 9-2.
Clock Generator Block Diagram
Power
Management
Controller
XIN
XOUT
PLLRCA
Slow Clock
SLCK
Main Clock
MAINCK
PLLA Clock
PLLACK
Control
Status
PLL and
Divider B
PLLRCB
PLLB Clock
PLLBCK
XIN32
XOUT32
Slow Clock
Oscillator
Main
Oscillator
PLL and
Divider A
Clock Generator
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PDF描述
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