參數(shù)資料
型號： AT91SAM7SE256-AU
廠商： Atmel
文件頁數(shù)： 84/682頁
文件大?。?/td> 0K
描述： IC ARM7 MCU FLASH 256K 128-LQFP
產(chǎn)品培訓(xùn)模塊： MCU Product Line Introduction
標(biāo)準包裝： 72
系列： SAM7SE
核心處理器： ARM7
芯體尺寸： 16/32-位
速度： 55MHz
連通性： EBI/EMI，I²C，SPI，SSC，UART/USART，USB
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 88
程序存儲器容量： 256KB（256K x 8）
程序存儲器類型： 閃存
RAM 容量： 32K x 8
電壓 - 電源 (Vcc/Vdd)： 1.65 V ~ 1.95 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 128-LQFP
包裝： 托盤
配用： AT91SAM7SE-EK-ND - EVAL BOARD FOR AT91SAM7SE
AT91SAM-ICE-ND - EMULATOR FOR AT91 ARM7/ARM9
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6222H–ATARM–25-Jan-12
SAM7SE512/256/32
22.6.5
Setup and Hold Cycles
The SMC allows some memory devices to be interfaced with different setup, hold and pulse
delays. These parameters are programmable and define the timing of each portion of the read
and write cycles. However, it is not possible to use this feature in early read protocol.
If an attempt is made to program the setup parameter as not equal to zero and the hold parame-
ter as equal to zero with WSEN = 0 (0 standard wait state), the SMC does not operate correctly.
If consecutive accesses are made to two different external memories and the second memory is
programmed with setup cycles, then no chip select change wait state is inserted (see Figure 22-
When a data float wait state (t
DF) is programmed on the first memory bank and when the second
memory bank is programmed with setup cycles, the SMC behaves as follows:
If the number of t
DF is higher or equal to the number of setup cycles, the number of setup
cycles inserted is equal to 0 (see Figure 22-24 on page 176).
If the number of the setup cycle is higher than the number of t
DF, the number of tDF inserted is
22.6.5.1
Read Access
The read cycle can be divided into a setup, a pulse length and a hold. The setup parameter can
have a value between 1.5 and 7.5 clock cycles, the hold parameter between 0 and 7 clock
cycles and the pulse length between 1.5 and 128.5 clock cycles, by increments of one.
Figure 22-19. Read Access with Setup and Hold
Figure 22-20. Read Access with Setup
NRD Setup
Pulse Length
NRD
A[22:0]
NRD Hold
MCK
NRD Setup
Pulse Length
NRD
A[22:0]
MCK
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