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參數(shù)資料
| 型號： | AT89S51-24PC |
| 廠商： | Atmel |
| 文件頁數(shù)： | 19/31頁 |
| 文件大小： | 0K |
| 描述： | IC 8051 MCU 4K FLASH 40-DIP |
| 標(biāo)準(zhǔn)包裝： | 10 |
| 系列： | 89S |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 24MHz |
| 連通性： | UART/USART |
| 外圍設(shè)備： | WDT |
| 輸入/輸出數(shù)： | 32 |
| 程序存儲器容量： | 4KB（4K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 128 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 4 V ~ 5.5 V |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 40-DIP（0.600"，15.24mm） |
| 包裝： | 管件 |
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26
2487D–MICRO–6/08
AT89S51
31. Shift Register Mode Timing Waveforms
32. AC Testing Input/Output Waveforms
Note:
1. AC Inputs during testing are driven at V
CC - 0.5V for a logic 1 and 0.45V for a logic 0. Timing measurements are made at VIH
min. for a logic 1 and VIL max. for a logic 0.
33. Float Waveforms(1)
Note:
1. For timing purposes, a port pin is no longer floating when a 100 mV change from load voltage occurs. A port pin begins to
float when a 100 mV change from the loaded VOH/VOL level occurs.
30. Serial Port Timing: Shift Register Mode Test Conditions
The values in this table are valid for V
CC = 4.0V to 5.5V and Load Capacitance = 80 pF.
Symbol
Parameter
12 MHz Osc
Variable Oscillator
Units
Min
Max
Min
Max
t
XLXL
Serial Port Clock Cycle Time
1.0
12 t
CLCL
s
tQVXH
Output Data Setup to Clock Rising Edge
700
10 tCLCL-133
ns
tXHQX
Output Data Hold After Clock Rising Edge
50
2 tCLCL-80
ns
t
XHDX
Input Data Hold After Clock Rising Edge
0
ns
tXHDV
Clock Rising Edge to Input Data Valid
700
10 tCLCL-133
ns
t
XHDV
t
QVXH
t
XLXL
t
XHDX
t
XHQX
ALE
INPUT DATA
CLEAR RI
OUTPUT DATA
WRITE TO SBUF
INSTRUCTION
CLOCK
0
1
2
3
4
5
6
7
SET TI
SET RI
8
VALID
0.45V
TEST POINTS
V
- 0.5V
CC
0.2 V
+ 0.9V
CC
0.2 V
- 0.1V
CC
V
LOAD
+ 0.1V
Timing Reference
Points
V
LOAD
- 0.1V
LOAD
V
OL
+ 0.1V
V
OL
- 0.1V
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PDF描述 |
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| AT89S52-16JC | 制造商:Atmel Corporation 功能描述: |
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