參數(shù)資料
型號： AT89LP52-20JU
廠商： Atmel
文件頁數(shù)： 109/117頁
文件大?。?/td> 0K
描述： IC MCU 8051 8K FLASH SPI 44PLCC
標準包裝： 27
系列： 89LP
核心處理器： 8051
芯體尺寸： 8-位
速度： 20MHz
連通性： EBI/EMI，I²C，SPI，UART/USART
外圍設備： 欠壓檢測/復位，POR，PWM，WDT
輸入/輸出數(shù)： 36
程序存儲器容量： 8KB（8K x 8）
程序存儲器類型： 閃存
RAM 容量： 256 x 8
電壓 - 電源 (Vcc/Vdd)： 2.4 V ~ 5.5 V
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 44-LCC（J 形引線）
包裝： *
91
3709D–MICRO–12/11
AT89LP51/52
17.9.6
Timing Parameters
and Figure 17-15 are shown in Table .
Note:
1. t
SCK is independent of tCLCL.
Table 17-6.
Programming Interface Timing Parameters
Symbol
Parameter
Min
Max
Units
t
CLCL
System Clock Cycle Time
0
60
ns
tPWRUP
Power On to SS High Time
10
s
tPOR
Power-on Reset Time
100
s
t
PWRDN
SS Tristate to Power Off
1
s
tRLZ
RST Low to I/O Tristate
tCLCL
2 tCLCL
ns
tSTL
RST Low Settling Time
100
ns
t
RHZ
RST High to SS Tristate
0
2 t
CLCL
ns
tSCK
Serial Clock Cycle Time
ns
tSHSL
Clock High Time
75
ns
t
SLSH
Clock Low Time
50
ns
tSR
Rise Time
25
ns
tSF
Fall Time
25
ns
t
SIS
Serial Input Setup Time
10
ns
tSIH
Serial Input Hold Time
10
ns
t
SOH
Serial Output Hold Time
10
ns
t
SOV
Serial Output Valid Time
35
ns
tPIS
Parallel Input Setup Time
10
ns
t
PIH
Parallel Input Hold Time
10
ns
t
POH
Parallel Output Hold Time
10
ns
tPOV
Parallel Output Valid Time
35
ns
t
SOE
Serial Output Enable Time
10
ns
t
SOX
Serial Output Disable Time
25
ns
tPOE
Parallel Output Enable Time
10
ns
t
POX
Parallel Output Disable Time
25
ns
t
SSE
RST Active Lead Time
t
SLSH
ns
tSSD
RST Inactive Lag Time
tSLSH
ns
t
ZSS
SCK Setup to SS Low
25
ns
t
SSZ
SCK Hold after SS High
25
ns
tWR
Write Cycle Time
2.5
ms
t
AWR
Write Cycle with Auto-Erase Time
5
ms
tERS
Chip Erase Cycle Time
7.5
ms
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PDF描述
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參數(shù)描述
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