參數(shù)資料
型號： AT89LP3240-20AU
廠商： Atmel
文件頁數(shù)： 6/200頁
文件大?。?/td> 0K
描述： MCU 8051 32K FLASH 20MHZ
標(biāo)準(zhǔn)包裝： 160
系列： 89LP
核心處理器： 8051
芯體尺寸： 8-位
速度： 20MHz
連通性： I²C，SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 38
程序存儲器容量： 32KB（32K x 8）
程序存儲器類型： 閃存
EEPROM 大小： 8K x 8
RAM 容量： 4.25K x 8
電壓 - 電源 (Vcc/Vdd)： 2.4 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 44-TQFP
包裝： 托盤
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103
3706C–MICRO–2/11
AT89LP3240/6440
Notes:1. Set up the clock mode before enabling the SPI: set all bits needed in SPCR except the SPE bit, then set SPE.
2. Enable the master SPI prior to the slave device.
3. Slave echoes master on the next Tx if not loaded with new data.
SPR0
SPR1
SPI clock rate select. These two bits control the SCK rate of the device configured as master. SPR1 and SPR0 have no
effect on the slave. The relationship between SCK and the oscillator frequency, F
OSC., is as follows:
SPR1
SPR0
SCK (TSCK = 0)
SCK (TSCK = 1)
00
f
OSC/4
f
T1OVF/4
01
f
OSC/8
fT1OVF/8
10
f
OSC/32
fT1OVF/32
11
f
OSC/64
f
T1OVF/64
Symbol
Function
Table 17-3.
SPDR – SPI Data Register
SPDR Address = EAH
Reset Value= 00H (after cold reset)
unchanged (after warm reset)
Not Bit Addressable
SPD7
SPD6
SPD5
SPD4
SPD3
SPD2
SPD1
SPD0
Bit
76543210
Table 17-4.
SPSR – SPI Status Register
SPSR Address = E8H
Reset Value = 0000 X000B
Not Bit Addressable
SPIF
WCOL
MODF
TXE
–
SSIG
DISSOENH
Bit
76543
210
Symbol
Function
SPIF
SPI Transfer Complete Interrupt Flag. When a serial transfer is complete, the SPIF bit is set by hardware and an interrupt
is generated if ESP = 1. The SPIF bit may be cleared by software or by reading the SPI status register followed by
reading/writing the SPI data register.
WCOL
Write Collision Flag. The WCOL bit is set by hardware if SPDR is written while the transmit buffer is full. The ongoing
transfer is not affected. WCOL may be cleared by software or by reading the SPI status register followed by
reading/writing the SPI data register.
MODF
Mode Fault Flag. MODF is set by hardware when a master mode collision is detected (MSTR = 1, SSIG = 0 and SS = 0)
and an interrupt is generated if ESP= 1. MODF must be cleared by software.
TXE
Transmit Buffer Empty Flag. Set by hardware when the transmit buffer is loaded into the shift register, allowing a new byte
to be loaded. TXE must be cleared by software. When ENH = 1 and ESP = 1, TXE will generate an interrupt.
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PDF描述
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AT89LP3240-20JU MCU 8051 32K FLASH 20MHZ
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參數(shù)描述
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