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參數(shù)資料
| 型號(hào)： | AT89C51RE2-RLTUM |
| 廠商： | Atmel |
| 文件頁(yè)數(shù)： | 29/187頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | MCU 8051 128K FLASH 44-VQFP |
| 產(chǎn)品培訓(xùn)模塊： | MCU Product Line Introduction |
| 標(biāo)準(zhǔn)包裝： | 800 |
| 系列： | 89C |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 60MHz |
| 連通性： | I²C，SPI，UART/USART |
| 外圍設(shè)備： | POR，PWM，WDT |
| 輸入/輸出數(shù)： | 34 |
| 程序存儲(chǔ)器容量： | 128KB（128K x 8） |
| 程序存儲(chǔ)器類(lèi)型： | 閃存 |
| RAM 容量： | 8K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 44-LQFP |
| 包裝： | 托盤(pán) |
| 配用： | AT89STK-11-ND - KIT STARTER FOR AT89C51RX2 |
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7663E–8051–10/08
AT89C51RE2
Hardware
Watchdog
Timer
The WDT is intended as a recovery method in situations where the CPU may be subjected to
software upset. The WDT consists of a 14-bit counter and the WatchDog Timer ReSeT
(WDTRST) SFR. The WDT is by default disabled from exiting reset. To enable the WDT, user
must write 01EH and 0E1H in sequence to the WDTRST, SFR location 0A6H. When WDT is
enabled, it will increment every machine cycle while the oscillator is running and there is no way
to disable the WDT except through reset (either hardware reset or WDT overflow reset). When
WDT overflows, it will drive an output RESET HIGH pulse at the RST-pin.
Using the WDT
To enable the WDT, user must write 01EH and 0E1H in sequence to the WDTRST, SFR loca-
tion 0A6H. When WDT is enabled, the user needs to service it by writing to 01EH and 0E1H to
WDTRST to avoid WDT overflow. The 14-bit counter overflows when it reaches 16383 (3FFFH)
and this will reset the device. When WDT is enabled, it will increment every machine cycle while
the oscillator is running. This means the user must reset the WDT at least every 16383 machine
cycle. To reset the WDT the user must write 01EH and 0E1H to WDTRST. WDTRST is a write
only register. The WDT counter cannot be read or written. When WDT overflows, it will generate
an output RESET pulse at the RST-pin. The RESET pulse duration is 96 x TCLK PERIPH, where
TCLK PERIPH= 1/FCLK PERIPH. To make the best use of the WDT, it should be serviced in those sec-
tions of code that will periodically be executed within the time required to prevent a WDT reset.
To have a more powerful WDT, a 2
7 counter has been added to extend the Time-out capability,
ranking from 16ms to 2s @ FOSCA = 12MHz. To manage this feature, refer to WDTPRG register
description, Table 92.
Table 92. WDTRST Register
WDTRST - Watchdog Reset Register (0A6h)
Reset Value = XXXX XXXXb
Write only, this SFR is used to reset/enable the WDT by writing 01EH then 0E1H in sequence.
7
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321
0
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相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AT89C51RE2-SLSUM | MCU 8BIT FLASH 2.7-5.5V 44-PLCC |
| VI-B2R-IY-F3 | CONVERTER MOD DC/DC 7.5V 50W |
| ATSAM3U1CA-AU | IC MCU 32BIT 64KB FLASH 100LQFP |
| AT91SAM7X128B-AU | IC MCU 128KB FLASH 100LQFP |
| VI-B2R-IY-F2 | CONVERTER MOD DC/DC 7.5V 50W |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AT89C51RE2-SLRUM | 功能描述:8位微控制器 -MCU C51RE2 128k FLASH 2.7V RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線(xiàn)寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
| AT89C51RE2-SLSEM | 制造商:ATMEL 制造商全稱(chēng):ATMEL Corporation 功能描述:8-bit Flash Microcontroller |
| AT89C51RE2-SLSUM | 功能描述:8位微控制器 -MCU C51RE2 128k FLASH 2.7V RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線(xiàn)寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
| AT89C51SND1 | 制造商:ATMEL 制造商全稱(chēng):ATMEL Corporation 功能描述:MP3 Microcontrollers |
| AT89C51SND1_06 | 制造商:ATMEL 制造商全稱(chēng):ATMEL Corporation 功能描述:USB Microcontrollers |
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