參數資料
| 型號： | AT89C5131A-TISIL |
| 廠商： | Atmel |
| 文件頁數： | 43/185頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC 8051 MCU FLASH 32K USB 28SOIC |
| 標準包裝： | 27 |
| 系列： | AT89C513x |
| 核心處理器： | C52X2 |
| 芯體尺寸： | 8-位 |
| 速度： | 48MHz |
| 連通性： | I²C，SPI，UART/USART，USB |
| 外圍設備： | LED，POR，PWM，WDT |
| 輸入/輸出數： | 18 |
| 程序存儲器容量： | 32KB（32K x 8） |
| 程序存儲器類型： | 閃存 |
| EEPROM 大?。?/td> | 4K x 8 |
| RAM 容量： | 1.25K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 振蕩器型： | 內部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 28-SOIC（0.295"，7.50mm 寬） |
| 包裝： | 管件 |
| 配用： | AT89STK-10-ND - KIT EVAL APPL MASS STORAGE AT89STK-05-ND - KIT STARTER FOR AT89C5131 |
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2008-2012 Microchip Technology Inc.
DS70318F-page 137
dsPIC33FJ06GS101/X02 and dsPIC33FJ16GSX02/X04
8.4
Oscillator Control Registers
REGISTER 8-1:
OSCCON: OSCILLATOR CONTROL REGISTER(1,2)
U-0
R-0
U-0
R/W-y
—
COSC<2:0>
—
NOSC<2:0>(3)
bit 15
bit 8
R/W-0
R-0
U-0
R/C-0
U-0
R/W-0
CLKLOCK
IOLOCK
LOCK
—CF
—
—OSWEN
bit 7
bit 0
Legend:
y = Value set from Configuration bits on POR
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
-n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
bit 15
Unimplemented: Read as ‘0’
bit 14-12
COSC<2:0>: Current Oscillator Selection bits (read-only)
111
= Fast RC oscillator (FRC) with divide-by-n
110
= Fast RC oscillator (FRC) with divide-by-16
101
= Low-Power RC oscillator (LPRC)
100
= Reserved
011
= Primary oscillator (XT, HS, EC) with PLL
010
= Primary oscillator (XT, HS, EC)
001
= Fast RC oscillator (FRC) with PLL
000
= Fast RC oscillator (FRC)
bit 11
Unimplemented: Read as ‘0’
bit 10-8
NOSC<2:0>: New Oscillator Selection bits(3)
111
= Fast RC oscillator (FRC) with divide-by-n
110
= Fast RC oscillator (FRC) with divide-by-16
101
= Low-Power RC oscillator (LPRC)
100
= Reserved
011
= Primary oscillator (XT, HS, EC) with PLL
010
= Primary oscillator (XT, HS, EC)
001
= Fast RC oscillator (FRC) with PLL
000
= Fast RC oscillator (FRC)
bit 7
CLKLOCK: Clock Lock Enable bit
If clock switching is enabled and FSCM is disabled, (FOSC<FCKSM> = 0b01):
1
= Clock switching is disabled, system clock source is locked
0
= Clock switching is enabled, system clock source can be modified by clock switching
bit 6
IOLOCK: Peripheral Pin Select Lock bit
1
= Peripherial pin select is locked, write to Peripheral Pin Select registers not allowed
0
= Peripherial pin select is not locked, write to Peripheral Pin Select registers allowed
bit 5
LOCK: PLL Lock Status bit (read-only)
1
= Indicates that PLL is in lock, or PLL start-up timer is satisfied
0
= Indicates that PLL is out of lock, start-up timer is in progress or PLL is disabled
bit 4
Unimplemented: Read as ‘0’
Note 1:
Writes to this register require an unlock sequence. Refer to Section 42. “Oscillator (Part IV)” (DS70307)
in the “dsPIC33F/PIC24H Family Reference Manual” (available from the Microchip website) for details.
2:
This register is reset only on a Power-on Reset (POR).
3:
Direct clock switches between any primary oscillator mode with PLL and FRCPLL mode are not permitted.
This applies to clock switches in either direction. In these instances, the application must switch to FRC
mode as a transition clock source between the two PLL modes.
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