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參數(shù)資料
| 型號： | AS9C25512M2018L-250BI |
| 廠商： | ALLIANCE SEMICONDUCTOR CORP |
| 元件分類： | DRAM |
| 英文描述： | 2.5V 512/256K x 18 Synchronous Dual-port SRAM with 3.3V or 2.5V interface |
| 中文描述： | 512K X 18 DUAL-PORT SRAM, 6.5 ns, PBGA256 |
| 封裝： | BGA-256 |
| 文件頁數(shù)： | 17/30頁 |
| 文件大?。?/td> | 1100K |
| 代理商： | AS9C25512M2018L-250BI |
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AS9C25512M2018L
AS9C25256M2018L
9/24/04, v.1.2
Alliance Semiconductor
P. 17 of 30
Interrupt timing wave form
[2]
Notes:
1. Parameters t
CYC
,t
CH
and t
CL
are different in Flow-through and Pipeline mode of operation and can be different for different ports (Refer AC Timing characteristics).
2. Chip Selected (CE0 = L and CE1 =H). True for both ports.
3. Address indicated is the Internal Address used and is dependent on the Address counter control inputs for that cycle.
4. 7FFFF (3FFFF for AS9C25256M2018L) is the Mailbox for port B and 7FFFE (3FFFE for AS9C25256M2018L) is the Mailbox for port A.
5. “Aa” and “Ab” refer to any other valid address other than 7FFFF or 7FFFE (3FFFF or 3FFFE for AS9C25256M2018L).
t
CYC[1]
t
CH[1]
t
CL[1]
CLK
A
R/W
A[2]
t
WS
t
WH
t
AS
t
AH
INT
A
ADDRESS
A[3]
CLK
B
R/W
B[2]
ADDRESS
B[3]
INT
B
7FFFF
t
WH
t
WS
t
CYC[1]
t
CH[1]
t
CL[1]
t
SINT
t
RINT
t
SINT
t
RINT
t
AH
t
AS
7FFFF
7FFFE
7FFFF
7FFFE
7FFFE
Don’t care
[4]
[4]
Aa
Aa
Aa
Aa
Ab
Ab
Ab
Ab
[5]
[5]
Aa
Ab
相關PDF資料 |
PDF描述 |
|---|---|
| AS9C25512M2018L-250FC | 2.5V 512/256K x 18 Synchronous Dual-port SRAM with 3.3V or 2.5V interface |
| AS9C25512M2018L-250FI | 2.5V 512/256K x 18 Synchronous Dual-port SRAM with 3.3V or 2.5V interface |
| AS9C25512M2018L-250TC | 2.5V 512/256K x 18 Synchronous Dual-port SRAM with 3.3V or 2.5V interface |
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| AS9C25512M2018L-133BC | TERM. F/O CABLE ST-SC/ DPLX/RISER/2M/BLUE |
相關代理商/技術參數(shù) |
參數(shù)描述 |
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| AS9C25512M2018L-250FI | 制造商:ALSC 制造商全稱:Alliance Semiconductor Corporation 功能描述:2.5V 512/256K x 18 Synchronous Dual-port SRAM with 3.3V or 2.5V interface |
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