參數(shù)資料
型號(hào)： AS9C25256M2036L
廠商： Alliance Semiconductor Corporation
英文描述： 2.5V 256/128K X 36 Synchronous Dual-port SRAM with 3.3V or 2.5V interface
中文描述： 2.5V的256/128K米鼠36同步雙與3.3V或2.5V接口端口靜態(tài)存儲(chǔ)器
文件頁(yè)數(shù)： 23/30頁(yè)
文件大?。?/td> 1109K
代理商： AS9C25256M2036L
AS9C25256M2036L
AS9C25128M2036L
9/30/04, v.1.3
Alliance Semiconductor
P. 23 of 30
IEEE 1149.1 Serial boundary scan (JTAG)
The SRAM incorporates a serial boundary scan Test Access Port (TAP). All JTAG pins operate using JEDEC standard 2.5V I/O logic levels.
In order to operate the device without using the JTAG feature, all JTAG pins may be left unconnected. On power-up, the device will start in
a reset state which will not interfere with normal device operation.
TAP Controller block diagram
Note:
1. x = 149
JTAG timing waveform
Selection
Circuitry
Selection
Circuitry
3130 29
Identification Register
0
1
2
.
.
.
Boundary Scan Register
1
Bypass Register
Instruction Register
x
[1]
0
1
2
0
1
2
0
. .
. . .
TDI
TMS
TCK
TDO
TAP Controller
3
TEST CLK
TCK
TRST
t
JCYC
TMS/TDI
TDO
t
JCH
t
JCL
t
JIS
t
JIH
t
JOH
t
JCD
t
JRS
t
JRR
Don’t care
Undefined
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PDF描述
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