參數(shù)資料
型號(hào)： AS7C3256A-8JCN
廠商： ALLIANCE SEMICONDUCTOR CORP
元件分類(lèi)： DRAM
英文描述： 3.3V 32K X 8 CMOS SRAM (Common I/O)
中文描述： 32K X 8 STANDARD SRAM, 8 ns, PDSO28
封裝： 0.300 INCH, LEAD FREE, PLASTIC, SOJ-28
文件頁(yè)數(shù)： 4/9頁(yè)
文件大小： 301K
代理商： AS7C3256A-8JCN
AS7C3256A-8
3/22/05; v.1.0
Alliance Semiconductor
P. 4 of 9
Read cycle (over the operating range)
2,8
Key to switching waveforms
Rising input
Read waveform 1 (address controlled)
2,5,6,8
Read waveform 2 (CE controlled)
2,5,7,8
Parameter
Symbol
t
RC
t
AA
t
ACE
t
OE
t
OH
t
CLZ
t
CHZ
t
OLZ
t
OHZ
t
PU
t
PD
-8
Unit
ns
Notes
Min
8
Max
–
Read cycle time
Address access time
–
8
ns
2
Chip enable (CE) access time
–
8
ns
2
Output enable (OE) access time
Output hold from address change
–
5
ns
3
–
ns
4
CE LOW to output in low Z
3
–
ns
3,4
CE HIGH to output in high Z
–
3
ns
3,4
OE LOW to output in low Z
0
–
ns
3,4
OE HIGH to output in high Z
–
3
ns
3,4
Power up time
Power down time
0
–
–
ns
ns
3,4
3,4
10
Undefined output/don’t care
Falling input
Address
D
out
Data valid
t
OH
t
AA
t
RC
Supply
current
CE
OE
D
out
t
RC1
t
OE
t
OLZ
t
ACE
t
CHZ
t
CLZ
t
PU
t
PD
I
CC
I
SB
50%
50%
t
OHZ
Data valid
相關(guān)PDF資料
PDF描述
AS7C3256 ECONOLINE: RSZ/P - 1kVDC
AS7C3256-12 Quadruple D-Type Flip-Flops With Clear 16-SO -40 to 85
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AS7C3256-20 Quadruple D-Type Flip-Flops With Clear 16-TSSOP -40 to 85
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參數(shù)描述
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