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參數(shù)資料
| 型號(hào)： | AS7C3256A-10TC |
| 廠商： | ALLIANCE SEMICONDUCTOR CORP |
| 元件分類： | DRAM |
| 英文描述： | Quadruple D-Type Flip-Flops With Clear 16-TSSOP -40 to 85 |
| 中文描述： | 32K X 8 STANDARD SRAM, 10 ns, PDSO28 |
| 封裝： | 8 X 13.40 MM, TSOP1-28 |
| 文件頁數(shù)： | 5/9頁 |
| 文件大?。?/td> | 248K |
| 代理商： | AS7C3256A-10TC |
AS7C3256A
4/23/04; v.2.0
Alliance Semiconductor
P. 5 of 9
Write cycle (over the operating range)
11
Write waveform 1 (WE controlled)
10,11
Write waveform 2 (CE controlled)
10,11
Parameter
Symbol
-10
-12
-15
-20
Unit
Notes
Min
Max
Min
Max
Min
Max
Min
Max
Write cycle time
t
WC
t
CW
t
AW
t
AS
t
WP
t
WR
t
AH
t
DW
t
DH
t
WZ
t
OW
10
–
12
–
15
–
20
–
ns
Chip enable to write end
Address setup to write end
8
8
–
–
8
8
–
–
10
10
–
–
12
12
–
–
ns
ns
Address setup time
0
–
0
–
0
–
0
–
ns
Write pulse width
Write recovery time
7
0
–
–
8
0
–
–
9
0
–
–
12
0
–
–
ns
ns
Address hold from end of write
0
–
0
–
0
–
0
–
ns
Data valid to write end
Data hold time
5
0
–
–
6
0
–
–
8
0
–
–
10
0
–
–
ns
ns
4, 5
Write enable to output in high Z
–
5
–
6
–
7
–
8
ns
4, 5
Output active from write end
3
–
3
–
3
–
3
–
ns
4, 5
t
AW
t
AH
t
WC
Address
WE
D
in
D
out
t
DH
t
OW
t
DW
t
WZ
t
WP
t
AS
Data valid
t
WR
t
AW
Address
CE
WE
D
in
D
out
Data valid
t
CW
t
WP
t
DW
t
DH
t
AH
t
WZ
t
WC
t
AS
t
WR
相關(guān)PDF資料 |
PDF描述 |
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