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參數(shù)資料
| 型號： | AS7C256A-20JI |
| 廠商： | ALLIANCE SEMICONDUCTOR CORP |
| 元件分類： | DRAM |
| 英文描述： | 5V 32K X 8 CMOS SRAM (Common I/O) |
| 中文描述： | 32K X 8 STANDARD SRAM, 20 ns, PDSO28 |
| 封裝： | 0.300 INCH, PLASTIC, SOJ-28 |
| 文件頁數(shù)： | 4/9頁 |
| 文件大?。?/td> | 248K |
| 代理商： | AS7C256A-20JI |
AS7C256A
9/24/04; v.1.2
Alliance Semiconductor
P. 4 of 9
Read cycle (over the operating range)
2,8
Key to switching waveforms
Rising input
Read waveform 1 (address controlled)
2,5,6,8
Read waveform 2 (CE controlled)
2,5,7,8
Parameter
Symbol
t
RC
t
AA
t
ACE
t
OE
t
OH
t
CLZ
t
CHZ
t
OLZ
t
OHZ
t
PU
t
PD
-10
-12
-15
-20
Unit
ns
Notes
Min
10
Max
–
Min
12
Max
–
Min
15
Max
–
Min
20
Max
–
Read cycle time
Address access time
–
10
–
12
–
15
–
20
ns
2
Chip enable (CE) access time
–
10
–
12
–
15
–
20
ns
2
Output enable (OE) access time
Output hold from address change
–
5
–
6
–
7
–
8
ns
3
–
3
–
3
–
3
–
ns
4
CE LOW to output in low Z
3
–
3
–
3
–
3
–
ns
3,4
CE HIGH to output in high Z
–
3
–
3
–
4
–
5
ns
3,4
OE LOW to output in low Z
0
–
0
–
0
–
0
–
ns
3,4
OE HIGH to output in high Z
–
3
–
3
–
4
–
5
ns
3,4
Power up time
Power down time
0
–
–
0
–
–
0
–
–
15
0
–
–
ns
ns
3,4
3,4
10
12
20
Undefined output/don’t care
Falling input
Address
D
out
Data valid
t
OH
t
AA
t
RC
Supply
current
CE
OE
D
out
t
RC1
t
OE
t
OLZ
t
ACE
t
CHZ
t
CLZ
t
PU
t
PD
I
CC
I
SB
50%
50%
t
OHZ
Data valid
相關PDF資料 |
PDF描述 |
|---|---|
| AS7C256A-20TC | 5V 32K X 8 CMOS SRAM (Common I/O) |
| AS7C256A-20TCN | 5V 32K X 8 CMOS SRAM (Common I/O) |
| AS7C256A-20TI | 5V 32K X 8 CMOS SRAM (Common I/O) |
| AS7C256A-20TIN | 5V 32K X 8 CMOS SRAM (Common I/O) |
| AS7C256B | 5V 32K X 8 CMOS SRAM (Common I/O) |
相關代理商/技術參數(shù) |
參數(shù)描述 |
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