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參數(shù)資料
| 型號： | AMD-640 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | 64-Bit Socket 7 Interface, Integrated Write back Cache Controller, System Memory Controller, and PCI Bus Controller.(64位系統(tǒng)控制器(包括高速緩沖存儲器控制器，系統(tǒng)存儲器控制器和PCI總線控制器)) |
| 中文描述： | 64位Socket 7的接口，集成寫回高速緩沖存儲器控制器，系統(tǒng)內存控制器和PCI總線控制器。（64位系統(tǒng)控制器（包括高速緩沖存儲器控制器，系統(tǒng)存儲器控制器和的PCI總線控制器）） |
| 文件頁數(shù)： | 7/159頁 |
| 文件大?。?/td> | 1900K |
| 代理商： | AMD-640 |
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vi
Table of Contents
AMD-640 System Controller Data Sheet
21090C/0—June 1997
Preliminary Information
7.5.11 32-Bit DRAM Width Control Register
7.5.12 DRAM Refresh Counter
7.5.13 DRAM Refresh Control Register
7.5.14 SDRAM Control Register
7.5.15 DRAM Drive Strength Control Register
7.5.16 ECC Control Register
7.5.17 ECC Status Register
(Offset 67h) . . . . 7-26
(Offset 6Ah) . . . . . . . . . . . . . . . 7-27
(Offset 6Bh) . . . . . . . . 7-27
(Offset 6Ch) . . . . . . . . . . . . . . 7-28
(Offset 6Dh) . . 7-29
(Offset 6Eh) . . . . . . . . . . . . . . . . . 7-30
(Offset 6Fh) . . . . . . . . . . . . . . . . . . 7-31
7.6
PCI Bus Control Registers . . . . . . . . . . . . . . . . . . . . . . . . . . .7-32
7.6.1
7.6.2
7.6.3
7.6.4
7.6.5
7.6.6
7.6.7
PCI Buffer Control Register
Processor-to-PCI Flow Control Register #1
Processor-to-PCI Flow Control Register #2
PCI Target Control Register
PCI Initiator Control Register
PCI Arbitration Control Register #1
PCI Arbitration Control Register #2
(Offset 70h) . . . . . . . . . . . . 7-32
(Offset 71h) 7-33
(Offset 72h) 7-35
(Offset 73h) . . . . . . . . . . . . 7-37
(Offset 74h) . . . . . . . . . . 7-38
(Offset 75h) . . . . . 7-39
(Offset 76h) . . . . . 7-40
8
Electrical Data
8-1
8.1
Absolute Ratings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .8-1
8.2
Operating Ranges . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .8-2
8.3
DC Characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .8-3
8.4
Power Dissipation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .8-4
9
Switching Characteristics
9-1
9.1
CLK Switching Characteristics . . . . . . . . . . . . . . . . . . . . . . . .9-2
9.2
Valid Delay, Float, Setup, and Hold Timings . . . . . . . . . . . .9-4
9.3
Processor Interface Timing . . . . . . . . . . . . . . . . . . . . . . . . . . .9-5
9.4
PCI Interface Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .9-6
9.5
DRAM Interface Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . .9-7
9.6
L2 Cache Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .9-8
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PDF描述 |
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參數(shù)描述 |
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