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參數(shù)資料
| 型號： | AM42DL1622DB70IS |
| 廠商： | ADVANCED MICRO DEVICES INC |
| 元件分類： | 存儲器 |
| 英文描述： | Am29DL16xD 16 Megabit (2 M x 8-Bit/1 M x 16-Bit) CMOS 3.0 Volt-only, Simultaneous Operation Flash Memory and 2 Mbit (128 K x 16-Bit) Static RAM |
| 中文描述： | SPECIALTY MEMORY CIRCUIT, PBGA69 |
| 封裝： | 8 X 11 MM, FBGA-69 |
| 文件頁數(shù)： | 116/128頁 |
| 文件大?。?/td> | 650K |
| 代理商： | AM42DL1622DB70IS |
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February 6, 2004
Am42DL16x2D
51
AC CHARACTERISTICS
SRAM Read Cycle
Note:
CE1#s = OE# = V
IL
, CE2s = WE# = V
IH
, UB#s and/or LB#s = V
IL
Figure 28.
SRAM Read Cycle—Address Controlled
Parameter
Symbol
Description
Speed Options
Unit
70
85
t
RC
Read Cycle Time
Min
70
85
ns
t
AA
Address Access Time
Max
70
85
ns
t
CO1
, t
CO2
Chip Enable to Output
Max
70
85
ns
t
OE
Output Enable Access Time
Max
35
45
ns
t
BA
LB#s, UB#s to Valid Output
Max
70
85
ns
t
LZ1
, t
LZ2
Chip Enable (CE1#s Low and CE2s High) to Low-Z
Output
Min
10
ns
t
BLZ
UB#, LB# Enable to Low-Z Output
Min
10
ns
t
OLZ
Output Enable to Low-Z Output
Min
5
ns
t
HZ1
, t
HZ2
Chip disable to High-Z Output
Min
0
ns
Max
25
t
BHZ
UB#s, LB#s Disable to High-Z Output
Min
0
ns
Max
25
t
OHZ
Output Disable to High-Z Output
Min
0
ns
Max
25
t
OH
Output Data Hold from Address Change
Min
10
15
ns
Address
Data Out
Previous Data Valid
Data Valid
t
AA
t
RC
t
OH
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PDF描述 |
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