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參數(shù)資料
| 型號： | AK2500B |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | RECEIVER, PDSO24 |
| 封裝： | SOP-24 |
| 文件頁數(shù)： | 14/17頁 |
| 文件大?。?/td> | 78K |
| 代理商： | AK2500B |
ASAHI KASEI
[AK2500B]
MS0005-E-00
- 6 -
1999/12
Equalizer Bypass
If the incoming signal is attenuated by flat loss only (zero cable loss), the internal equalizer should be bypassed
with MODE1=1, MODE2=1. (See Table 4)
The level of the incoming signal should satisfy the RIN input range
(50mVpk - 1000mVpk for DS3/STS-1).
Table 4. Mode Control
MODE2
(pin24)
MODE1
(pin23)
Function
0
Equalizer Enable
OPEN
TEST MODE (Factory use only)
1
Equalizer Bypass
(1)Cable loss 0 - 450feet
+
Flat loss
0 - 450feet
Flat Loss
Cable
0 - 6dB
AK2500B
MODE2
MODE1
Transmitter
Monitoring
circuit
(2)Flat loss only
DSX-3
Flat Loss
AK2500B
MODE2
MODE1
Equalizer bypass
1
Equalizer enable
0
Fig. 1 AK2500B Application
Clock Acquisition
If a valid input signal is assumed to be already present at the analog input, the maximum time between the
application of device power and error-free operation is typically 20 ms.
Table 5. PLL Lock Acquisition Time
(TA = Tmin to Tmax; V+ = 3.3V
±0.3V; GND = 0V)
Conditions
min
typ
Max
Units
Power up
Power : Off
->
On
Input data : Valid
20
ms
Input data restore
Power : On
Input data : Loss -> Valid
1.0
5.0
ms
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PDF描述 |
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參數(shù)描述 |
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