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參數(shù)資料
| 型號： | AGLP060V5-CSG201 |
| 廠商： | Microsemi SoC |
| 文件頁數(shù)： | 34/134頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA IGLOO PLUS 60K 201-CSP |
| 標(biāo)準(zhǔn)包裝： | 384 |
| 系列： | IGLOO PLUS |
| 邏輯元件/單元數(shù)： | 1584 |
| RAM 位總計： | 18432 |
| 輸入/輸出數(shù)： | 157 |
| 門數(shù)： | 60000 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 201-VFBGA，CSBGA |
| 供應(yīng)商設(shè)備封裝： | 201-CSP（8x8） |
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IGLOO PLUS Low Power Flash FPGAs
Revision 16
5-3
Revision 11
(continued)
Table 2-2 Recommended Operating Conditions1,2 was revised. 1.2 V DC wide
range supply voltage and 3.3 V wide range supply voltage (SAR 26270) were added
for VCCI. VJTAG DC Voltage was revised (SAR 24052). The value range for VPUMP
programming voltage for operation was changed from "0 to 3.45" to "0 to 3.6" (SAR
25220).
The tables in the "Quiescent Supply Current" section were updated (SARs 24882
and 24112). Some of the table notes were changed or deleted.
VIH maximum values in tables were updated as needed to 3.6 V (SARs 20990,
79370).
N/A
The values in the following tables were updated. 3.3 V LVCMOS and 1.2 V LVCMOS
wide range were added to the tables where applicable.
A table note was added to Table 2-16 Different Components Contributing to the
stating the value for PDC4 is the minimum contribution of the PLL when operating at
lowest frequency.
2-11,
Table 2-29 I/O Weak Pull-Up/Pull-Down Resistances was revised, including
addition of 3.3 V and 1.2 V LVCMOS wide range.
The notes defining RWEAK PULL-UP-MAX and RWEAK PULLDOWN-MAX were revised
(SAR 21348).
Table 2-30 I/O Short Currents IOSH/IOSL was revised to include data for 3.3 V and
1.2 V LVCMOS wide range (SAR 79353 and SAR 79366).
Table 2-31 Duration of Short Circuit Event before Failure was revised to change the
maximum temperature from 110°C to 100°C, with an example of six months instead
of three months (SAR 26259).
Revision
Changes
Page
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