Revision 17 2-43 Fully Registered I/O Buffers with Asynchronous Clear Figure 2-13 Timing Model of " />
參數(shù)資料
型號: AGLN030V5-ZVQ100
廠商: Microsemi SoC
文件頁數(shù): 106/150頁
文件大小: 0K
描述: IC FPGA NANO 1KB 30K 100VQFP
標準包裝: 90
系列: IGLOO nano
邏輯元件/單元數(shù): 768
輸入/輸出數(shù): 77
門數(shù): 30000
電源電壓: 1.425 V ~ 1.575 V
安裝類型: 表面貼裝
工作溫度: -20°C ~ 70°C
封裝/外殼: 100-TQFP
供應(yīng)商設(shè)備封裝: 100-VQFP(14x14)
IGLOO nano Low Power Flash FPGAs
Revision 17
2-43
Fully Registered I/O Buffers with Asynchronous Clear
Figure 2-13 Timing Model of the Registered I/O Buffers with Asynchronous Clear
CLK
Pad
Out
CLK
CLR
Data_out
Data
Y
AA
EOUT
DOUT
Core
Array
DQ
DFN1C1
CLR
DQ
DFN1C1
CLR
DQ
DFN1C1
CLR
D_Enable
CC
DD
EE
FF
LL
HH
JJ
CLKBUF
INBUF
TRIBUF
INBUF
CLKBUF
INBUF
Data Input I/O Register with
Active High Clear
Positive-Edge Triggered
Data Output Register and
Enable Output Register with
Active High Clear
Positive-Edge Triggered
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PDF描述
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參數(shù)描述
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