2-40 Revision 23 The length of time an I/O can withstand IOSH
參數(shù)資料
型號： AGL400V5-CS196I
廠商： Microsemi SoC
文件頁數(shù)： 203/250頁
文件大小： 0K
描述： IC FPGA 1KB FLASH 400K 196-CSP
標(biāo)準(zhǔn)包裝： 168
系列： IGLOO
邏輯元件/單元數(shù)： 9216
RAM 位總計： 55296
輸入/輸出數(shù)： 143
門數(shù)： 400000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 85°C
封裝/外殼： 196-TFBGA，CSBGA
供應(yīng)商設(shè)備封裝： 196-CSP（8x8）
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IGLOO DC and Switching Characteristics
2-40
Revision 23
The length of time an I/O can withstand IOSH/IOSL events depends on the junction temperature. The
reliability data below is based on a 3.3 V, 12 mA I/O setting, which is the worst case for this type of
analysis.
For example, at 100°C, the short current condition would have to be sustained for more than six months
to cause a reliability concern. The I/O design does not contain any short circuit protection, but such
protection would only be needed in extremely prolonged stress conditions.
Table 2-44 I/O Short Currents IOSH/IOSL
Applicable to Standard I/O Banks
Drive Strength
IOSL (mA)*
IOSH (mA)*
3.3 V LVTTL / 3.3 V LVCMOS
2 mA
25
27
4 mA
25
27
6 mA
51
54
8 mA
51
54
3.3 V LVCMOS Wide Range
100
A
Same as regular 3.3 V LVCMOS Same as regular 3.3 V LVCMOS
2.5 V LVCMOS
2 mA
16
18
4 mA
16
18
6 mA
32
37
8 mA
32
37
1.8 V LVCMOS
2 mA
9
11
4 mA
17
22
1.5 V LVCMOS
2 mA
13
16
1.2 V LVCMOS
1 mA
20
26
1.2 V LVCMOS Wide Range
100
A20
26
Note: *TJ = 100°C
Table 2-45 Duration of Short Circuit Event before Failure
Temperature
Time before Failure
–40°C
> 20 years
–20°C
> 20 years
0°C
> 20 years
25°C
> 20 years
70°C
5 years
85°C
2 years
100°C
6 months
Table 2-46 I/O Input Rise Time, Fall Time, and Related I/O Reliability1
Input Buffer
Input Rise/Fall Time
(min.)
Input Rise/Fall Time
(max.)
Reliability
LVTTL/LVCMOS
No requirement
10 ns *
20 years (100°C)
LVDS/B-LVDS/M-LVDS/
LVPECL
No requirement
10 ns *
10 years (100°C)
Note: The maximum input rise/fall time is related to the noise induced into the input buffer trace. If the
noise is low, then the rise time and fall time of input buffers can be increased beyond the
maximum value. The longer the rise/fall times, the more susceptible the input signal is to the
board noise. Microsemi recommends signal integrity evaluation/characterization of the system to
ensure that there is no excessive noise coupling into input signals.
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