Revision 23 2-97 1.2 V DC Core Voltage Table 2-168 Output DDR Propagation Delays Comme" />
參數(shù)資料
型號： AGL250V5-CS196
廠商： Microsemi SoC
文件頁數(shù)： 17/250頁
文件大?。?/td> 0K
描述： IC FPGA 1KB FLASH 250K 196-CSP
標(biāo)準(zhǔn)包裝： 168
系列： IGLOO
邏輯元件/單元數(shù)： 6144
RAM 位總計(jì)： 36864
輸入/輸出數(shù)： 143
門數(shù)： 250000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 196-TFBGA，CSBGA
供應(yīng)商設(shè)備封裝： 196-CSP（8x8）
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IGLOO Low Power Flash FPGAs
Revision 23
2-97
1.2 V DC Core Voltage
Table 2-168 Output DDR Propagation Delays
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.14 V
Parameter
Description
Std.
Units
tDDROCLKQ
Clock-to-Out of DDR for Output DDR
1.60
ns
tDDROSUD1
Data_F Data Setup for Output DDR
1.09
ns
tDDROSUD2
Data_R Data Setup for Output DDR
1.16
ns
tDDROHD1
Data_F Data Hold for Output DDR
0.00
ns
tDDROHD2
Data_R Data Hold for Output DDR
0.00
ns
tDDROCLR2Q
Asynchronous Clear-to-Out for Output DDR
1.99
ns
tDDROREMCLR
Asynchronous Clear Removal Time for Output DDR
0.00
ns
tDDRORECCLR
Asynchronous Clear Recovery Time for Output DDR
0.24
ns
tDDROWCLR1
Asynchronous Clear Minimum Pulse Width for Output DDR
0.19
ns
tDDROCKMPWH
Clock Minimum Pulse Width High for the Output DDR
0.31
ns
tDDROCKMPWL
Clock Minimum Pulse Width Low for the Output DDR
0.28
ns
FDDOMAX
Maximum Frequency for the Output DDR
160.00
MHz
Note: For specific junction temperature and voltage supply levels, refer to Table 2-7 on page 2-7 for derating values.
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PDF描述
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