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參數(shù)資料
| 型號： | AGL125V2-VQG100I |
| 廠商： | Microsemi SoC |
| 文件頁數(shù)： | 9/250頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA IGLOO 1.2-1.5V 100VQFP |
| 標準包裝： | 90 |
| 系列： | IGLOO |
| 邏輯元件/單元數(shù)： | 3072 |
| RAM 位總計： | 36864 |
| 輸入/輸出數(shù)： | 71 |
| 門數(shù)： | 125000 |
| 電源電壓： | 1.14 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-TQFP |
| 供應商設備封裝： | 100-VQFP（14x14） |
| 其它名稱： | 1100-1098 |
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IGLOO DC and Switching Characteristics
2-90
Revision 23
Output Enable Register
Timing Characteristics
1.5 V DC Core Voltage
Figure 2-20 Output Enable Register Timing Diagram
50%
Preset
Clear
EOUT
CLK
D_Enable
Enable
tOESUE
50%
tOESUDtOEHD
50%
tOECLKQ
1
0
tOEHE
tOERECPRE
tOEREMPRE
tOERECCLR
tOEREMCLR
tOEWCLR
tOEWPRE
tOEPRE2Q
tOECLR2Q
tOECKMPWH tOECKMPWL
50%
Table 2-161 Output Enable Register Propagation Delays
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.425 V
Parameter
Description
Std. Units
tOECLKQ
Clock-to-Q of the Output Enable Register
0.75
ns
tOESUD
Data Setup Time for the Output Enable Register
0.51
ns
tOEHD
Data Hold Time for the Output Enable Register
0.00
ns
tOESUE
Enable Setup Time for the Output Enable Register
0.73
ns
tOEHE
Enable Hold Time for the Output Enable Register
0.00
ns
tOECLR2Q
Asynchronous Clear-to-Q of the Output Enable Register
1.13
ns
tOEPRE2Q
Asynchronous Preset-to-Q of the Output Enable Register
1.13
ns
tOEREMCLR
Asynchronous Clear Removal Time for the Output Enable Register
0.00
ns
tOERECCLR
Asynchronous Clear Recovery Time for the Output Enable Register
0.24
ns
tOEREMPRE
Asynchronous Preset Removal Time for the Output Enable Register
0.00
ns
tOERECPRE
Asynchronous Preset Recovery Time for the Output Enable Register
0.24
ns
tOEWCLR
Asynchronous Clear Minimum Pulse Width for the Output Enable Register
0.19
ns
tOEWPRE
Asynchronous Preset Minimum Pulse Width for the Output Enable Register
0.19
ns
tOECKMPWH Clock Minimum Pulse Width High for the Output Enable Register
0.31
ns
tOECKMPWL
Clock Minimum Pulse Width Low for the Output Enable Register
0.28
ns
Note: For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-7 for derating values.
相關PDF資料 |
PDF描述 |
|---|---|
| VE-B1P-CV-F1 | CONVERTER MOD DC/DC 13.8V 150W |
| GSM43DRYI | CONN EDGECARD 86POS DIP .156 SLD |
| EEM12DRUH | CONN EDGECARD 24POS DIP .156 SLD |
| VI-B1P-CV-F4 | CONVERTER MOD DC/DC 13.8V 150W |
| DBML25S500 | CONN DSUB RCPT 25POS T/H RA GOLD |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| AGL125V2-VQG100T | 制造商:Microsemi Corporation 功能描述:AGL125V2-VQG100T - Trays |
| AGL125V2-VQG144 | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:IGLOO Low-Power Flash FPGAs with Flash Freeze Technology |
| AGL125V2-VQG144ES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:IGLOO Low-Power Flash FPGAs with Flash Freeze Technology |
| AGL125V2-VQG144I | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:IGLOO Low-Power Flash FPGAs with Flash Freeze Technology |
| AGL125V2-VQG144PP | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:IGLOO Low-Power Flash FPGAs with Flash Freeze Technology |
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